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74LVC16240ADGG,112

更新时间： 2024-01-21 16:54:51

品牌	Logo	应用领域
恩智浦 - NXP		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
16页	168K
描述
74LVC16240A - 16-bit buffer/line driver with 5 V tolerant inputs/outputs; inverting; 3-state TSSOP 48-Pin

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74LVC16240ADGG,112 技术参数

是否Rohs认证：	符合	生命周期：	Active
零件包装代码：	TSSOP	包装说明：	TSSOP,
针数：	48	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.15
系列：	LVC/LCX/Z	JESD-30 代码：	R-PDSO-G48
JESD-609代码：	e4	长度：	12.5 mm
逻辑集成电路类型：	BUS DRIVER	湿度敏感等级：	1
位数：	4	功能数量：	4
端口数量：	2	端子数量：	48
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	输出极性：	INVERTED
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	NOT SPECIFIED	传播延迟（tpd）：	6.5 ns
认证状态：	Not Qualified	座面最大高度：	1.2 mm
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	1.2 V
标称供电电压 (Vsup)：	2.7 V	表面贴装：	YES
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	6.1 mm
Base Number Matches：	1

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74LVC16240A

16-bit buffer/line driver with 5V tolerant inputs/outputs;

inverting; 3-state

Rev. 4 — 3 November 2011

Product data sheet

1. General description

The 74LVC16240A is a 16-bit inverting buffer/line driver with 3-state outputs. The device

can be used as four 4-bit buffers, two 8-bit buffers or one 16-bit buffer. The device

features four output enables (1OE, 2OE, 3OE and 4OE), each controlling four of the

3-state outputs. A HIGH on nOE causes the outputs to assume a high-impedance

OFF-state.

Inputs can be driven from either 3.3 V or 5 V devices. When disabled, up to 5.5 V can be

applied to the outputs. These features allow the use of these devices in mixed

3.3 V and 5 V applications.

This device is fully specified for partial power-down applications using I_OFF. The I_OFF

circuitry disables the output, preventing the damaging backflow current through the device

when it is powered down.

2. Features and benefits

 5 V tolerant inputs/outputs for interfacing with 5 V logic

 Wide supply voltage range from 1.2 V to 3.6 V

 CMOS low power consumption

 MULTIBYTE flow-through standard pin-out architecture

 Low inductance multiple power and ground pins for minimum noise and ground

bounce

 Direct interface with TTL levels

 Complies with JEDEC standard:

 JESD8-7A (1.65 V to 1.95 V

 JESD8-5A (2.3 V to 2.7 V

 JESD8-C/JESD36 (2.7 V to 3.6 V

 ESD protection:

 HBM JESD22-A114F exceeds 2000 V

 MM JESD22-A115B exceeds 200 V

 CDM JESD22-C101E exceeds 1000 V

 Specified from 40 C to +85 C and from 40 C to +125 C.

12 3 4 5 6 7...16

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