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74HCT574DB,118

更新时间: 2024-10-28 14:47:03
品牌 Logo 应用领域
恩智浦 - NXP 驱动光电二极管逻辑集成电路触发器
页数 文件大小 规格书
7页 57K
描述
74HC(T)574 - Octal D-type flip-flop; positive edge-trigger; 3-state SSOP2 20-Pin

74HCT574DB,118 技术参数

是否Rohs认证: 符合生命周期:Transferred
零件包装代码:SSOP2包装说明:SSOP, SSOP20,.3
针数:20Reach Compliance Code:compliant
HTS代码:8542.39.00.01风险等级:5.2
其他特性:BROADSIDE VERSION OF 374系列:HCT
JESD-30 代码:R-PDSO-G20JESD-609代码:e4
长度:7.2 mm负载电容(CL):50 pF
逻辑集成电路类型:BUS DRIVER最大频率@ Nom-Sup:20000000 Hz
最大I(ol):0.006 A湿度敏感等级:1
位数:8功能数量:1
端口数量:2端子数量:20
最高工作温度:125 °C最低工作温度:-40 °C
输出特性:3-STATE输出极性:TRUE
封装主体材料:PLASTIC/EPOXY封装代码:SSOP
封装等效代码:SSOP20,.3封装形状:RECTANGULAR
封装形式:SMALL OUTLINE, SHRINK PITCH包装方法:TAPE AND REEL
峰值回流温度(摄氏度):260电源:5 V
传播延迟(tpd):50 ns认证状态:Not Qualified
座面最大高度:2 mm子类别:FF/Latches
最大供电电压 (Vsup):5.5 V最小供电电压 (Vsup):4.5 V
标称供电电压 (Vsup):5 V表面贴装:YES
技术:CMOS温度等级:AUTOMOTIVE
端子面层:NICKEL PALLADIUM GOLD端子形式:GULL WING
端子节距:0.65 mm端子位置:DUAL
处于峰值回流温度下的最长时间:30触发器类型:POSITIVE EDGE
宽度:5.3 mmBase Number Matches:1

74HCT574DB,118 数据手册

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Philips Semiconductors  
Product specification  
Octal D-type flip-flop; positive edge-trigger;  
3-state  
74HC/HCT574  
DC CHARACTERISTICS FOR 74HC  
For the DC characteristics see “74HC/HCT/HCU/HCMOS Logic Family Specifications”.  
Output capability: bus driver  
ICC category: MSI  
AC CHARACTERISTICS FOR 74HC  
GND = 0 V; tr = tf = 6 ns; CL = 50 pF  
Tamb (°C)  
TEST CONDITIONS  
74HC  
SYMBOL PARAMETER  
UNIT  
VCC  
(V)  
+25  
40 to +85 40 to +125  
WAVEFORMS  
min. typ. max. min. max. min. max.  
tPHL/ tPLH propagation delay  
CP to Qn  
47  
17  
14  
150  
30  
26  
190  
35  
33  
225  
45  
38  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
2.0 Fig.6  
4.5  
6.0  
t
t
t
PZH/ tPZL 3-state output enable  
time OE to Qn  
44  
16  
13  
140  
28  
24  
175  
35  
30  
210  
42  
36  
2.0 Fig.7  
4.5  
6.0  
PHZ/ tPLZ 3-state output disable  
time OE to Qn  
39  
14  
11  
125  
25  
21  
155  
31  
26  
190  
38  
32  
2.0 Fig.7  
4.5  
6.0  
THL/ tTLH output transition time  
14  
5
4
60  
12  
10  
75  
15  
13  
90  
18  
15  
2.0 Fig.6  
4.5  
6.0  
tW  
clock pulse width  
HIGH or LOW  
80  
16  
14  
14  
5
4
100  
20  
17  
120  
24  
20  
2.0 Fig.6  
4.5  
6.0  
tsu  
set-up time  
Dn to CP  
60  
12  
10  
6
2
2
75  
15  
13  
90  
18  
15  
2.0 Fig.8  
4.5  
6.0  
th  
hold time  
Dn to CP  
5
5
5
0
0
0
5
5
5
5
5
5
2.0 Fig.8  
4.5  
6.0  
fmax  
maximum clock pulse  
frequency  
6.0  
30  
35  
37  
112  
133  
4.8  
24  
28  
4.0  
20  
24  
MHz 2.0 Fig.6  
4.5  
6.0  
December 1990  
5

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