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74HCT373D-T

更新时间： 2024-11-11 20:32:47

品牌	Logo	应用领域
恩智浦 - NXP		驱动光电二极管输出元件逻辑集成电路
页数	文件大小	规格书
26页	132K
描述
IC HCT SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDSO20, 7.50 MM, PLASTIC, MS-013, SOT-163-1, SOP-20, Bus Driver/Transceiver

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74HCT373D-T 技术参数

Source Url Status Check Date：	2013-06-14 00:00:00	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	7.50 MM, PLASTIC, MS-013, SOT-163-1, SOP-20	针数：	20
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.31	Is Samacsys：	N
系列：	HCT	JESD-30 代码：	R-PDSO-G20
JESD-609代码：	e4	长度：	12.8 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	BUS DRIVER
最大I（ol）：	0.006 A	湿度敏感等级：	1
位数：	8	功能数量：	1
端口数量：	2	端子数量：	20
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP20,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	包装方法：	TAPE AND REEL
峰值回流温度（摄氏度）：	260	电源：	5 V
Prop。Delay @ Nom-Sup：	45 ns	传播延迟（tpd）：	48 ns
认证状态：	Not Qualified	座面最大高度：	2.65 mm
子类别：	FF/Latches	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	7.5 mm	Base Number Matches：	1

74HCT373D-T 数据手册

74HC373; 74HCT373

Octal D-type transparent latch; 3-state

Rev. 03 — 20 January 2006

Product data sheet

1. General description

The 74HC373; 74HCT373 is a high-speed Si-gate CMOS device and is pin compatible

with Low-power Schottky TTL. It is speciﬁed in compliance with JEDEC standard no. 7A.

The 74HC373; 74HCT373 is an octal D-type transparent latch featuring separate D-type

inputs for each latch and 3-state outputs for bus oriented applications. A latch enable (LE)

input and an output enable (OE) input are common to all latches.

The 74HC373; HCT373 consists of eight D-type transparent latches with 3-state true

outputs. When LE is HIGH, data at the Dn inputs enters the latches. In this condition the

latches are transparent, i.e. a latch output will change state each time its corresponding

D input changes.

When LE is LOW the latches store the information that was present at the D inputs a

set-up time preceding the HIGH-to-LOW transition of LE. When OE is LOW, the contents

of the 8 latches are available at the outputs. When OE is HIGH, the outputs go to the high-

impedance OFF-state. Operation of the OE input does not affect the state of the latches.

The 74HC373; 74HCT373 is functionally identical to:

• 74HC533; 74HCT533: but inverted outputs

• 74HC563; 74HCT563: but inverted outputs and different pin arrangement

• 74HC573; 74HCT573: but different pin arrangement

2. Features

■ 3-state non-inverting outputs for bus oriented applications

■ Common 3-state output enable input

■ Functionally identical to the 74HC563; 74HCT563, 74HC573; 74HCT573 and

74HC533; 74HCT533

■ ESD protection:

◆ HBM EIA/JESD22-A114-C exceeds 2000 V

◆ MM EIA/JESD22-A115-A exceeds 200 V

■ Speciﬁed from −40 °C to +85 °C and from −40 °C to +125 °C

12 3 4 5 6 7...26

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型号	品牌	获取价格	描述	数据表
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74HCT373PW	NXP	获取价格	Octal D-type transparent latch; 3-state
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74HCT373PW-T	NXP	获取价格	暂无描述
74HCT373-Q100	NXP	获取价格	Octal D-type transparent latch; 3-state
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