Datasheet > 电信电路 > ATM/SONET/SDH 集成电路> XRT91L33IG-F

XRT91L33IG-F

更新时间： 2024-01-21 04:33:54

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艾科嘉 - EXAR		ATM集成电路 SONET集成电路 SDH集成电路电信集成电路电信电路光电二极管异步传输模式时钟
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STS-12/STS-3 MULTIRATE CLOCK AND DATA RECOVERY UNIT

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XRT91L33IG-F 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	TSSOP,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	1.76
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e3
长度：	6.5 mm	湿度敏感等级：	1
功能数量：	1	端子数量：	20
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	1.2 mm	标称供电电压：	3.3 V
表面贴装：	YES	电信集成电路类型：	ATM/SONET/SDH SUPPORT CIRCUIT
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	40
Base Number Matches：	1

XRT91L33IG-F 数据手册

XRT91L33

STS-12/STS-3 MULTIRATE CLOCK AND DATA RECOVERY UNIT

AUG 2008

REV. V1.0.0

FEATURES

APPLICATIONS

• Performs clock and data recovery for selectable

data of 622.08 Mbps (STS-12/STM-4) or 155.52

Mbps (STS-3/STM-1) NRZ data

• SONET/SDH-based Transmission Systems

• Add/Drop Multiplexers

• Meets Telcordia, ANSI and ITU-T G.783 and G.825

SDH jitter requirements including T1.105.03 - 2002

SONET Jitter Tolerance specification, and GR-253

CORE, GR-253 ILR SONET Jitter specifications.

• Cross Connect Equipment

• ATM and Multi-Service Switches, Routers and

Switch/Routers

• Lock output pin monitors data run length and

frequency drift from reference clock

• DSLAMS

• SONET/SDH Test Equipment

• DWDM Termination Equipment

• Data is resampled at the output

• Active High Signal Detect (SIGD) LVPECL input

• Low jitter, high-speed outputs support LVPECL and

low-power LVDS termination

GENERAL DESCRIPTION

• 19.44 MHz reference frequency LVTTL input

• Low power: 215 mW typical

• 3.3V power supply

The XRT91L33 is a fully integrated multirate Clock

and Data Recovery (CDR) device for SONET/SDH

622.08 Mbps STS-12/STM-4 or 155.52 Mbps STS-3/

STM-1 applications. The device provides Clock and

Data Recovery (CDR) function by synchronizing its

on-chip Voltage Controlled Oscillator (VCO) to the

incoming serial scrambled non-return to zero (NRZ)

data stream. Figure 1 shows the block diagram of

the XRT91L33.

• 20-pin TSSOP package

• Requires one external capacitor

• PLL bypass operation facilitates board debug

process

• ESD greater than 2kV on all pins

FIGURE 1. BLOCK DIAGRAM OF XRT91L33

STS12_MODE

REFCK

19.44 MHz

CAP+

1u F

PLL

RX LOOP

FILTER

CAP+

TEST

LVDS/LVPECL

Output Drivers

Differential

Receiver

RXDIP

RECVD-

DATAOUT

RXDOP

RXDATAIN

CDR

RXDIN

RXDON

STS-12/3

Internal

biasing

STM-4/1

Clock and Data

Recovery

External

100R

termination

RECVD-

CLKOUT

RXCLKOP

RXCLKON

LOCK

LCKTOREFN

SIGD

MUTE

RXDO

Exar Corporation 48720 Kato Road, Fremont CA, 94538 • (510) 668-7000 • FAX (510) 668-7017 • www.exar.com

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