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XRT91L33AIG-F

更新时间： 2024-02-16 01:24:37

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艾科嘉 - EXAR		ATM 异步传输模式电信光电二极管电信集成电路
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18页	192K
描述
Clock Recovery Circuit, 1-Func, PDSO20, LEAD FREE, TSSOP-20

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XRT91L33AIG-F 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP20,.25	针数：	20
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.77	应用程序：	ATM;SDH;SONET
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e3
长度：	6.5 mm	湿度敏感等级：	1
功能数量：	1	端子数量：	20
最高工作温度：	95 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP20,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
电源：	3.3 V	认证状态：	Not Qualified
座面最大高度：	1.2 mm	子类别：	ATM/SONET/SDH ICs
最大压摆率：	0.08 mA	标称供电电压：	3.3 V
表面贴装：	YES	电信集成电路类型：	ATM/SONET/SDH CLOCK RECOVERY CIRCUIT
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	40
Base Number Matches：	1

XRT91L33AIG-F 数据手册

XRT91L33A

STS-12/STS-3 MULTIRATE CLOCK AND DATA RECOVERY UNIT

JUNE 2010

REV. 1.0.1

FEATURES

 Enhanced Jitter performance

 Meets both Jitter tolerance and generation

requirements

 Performs clock and data recovery for selectable

data of 622.08 Mbps (STS-12/STM-4) or 155.52

Mbps (STS-3/STM-1) NRZ data

 Meets Telcordia, ANSI and ITU-T G.783 and G.825

SDH jitter requirements including T1.105.03 - 2002

SONET Jitter Tolerance specification, and GR-253

CORE, GR-253 ILR SONET Jitter specifications.

APPLICATIONS

 SONET/SDH-based Transmission Systems

 DSLAMS and Add/Drop Multiplexers

 Cross Connect Equipment

 LOCK is a status output that monitors data run

length and frequency drift away from the reference

clock

 ATM and Multi-Service Switches, Routers and

Switch/Routers

 Data is resampled at the output

 DWDM Termination Equipment

 Active High Signal Detect (SIGD) LVPECL input

 Low jitter, high-speed outputs support LVPECL and

low-power LVDS termination

GENERAL DESCRIPTION

 19.44 MHz reference frequency LVTTL input

 Low power: 215 mW typical

 3.3V power supply

The XRT91L33A is a fully integrated multirate Clock

and Data Recovery (CDR) device for SONET/SDH

622.08 Mbps STS-12/STM-4 or 155.52 Mbps STS-3/

STM-1 applications. The device provides Clock and

Data Recovery (CDR) function by synchronizing its

on-chip Voltage Controlled Oscillator (VCO) to the

incoming serial scrambled non-return to zero (NRZ)

data stream. Figure 1 shows the block diagram of

the XRT91L33A.

 20-pin TSSOP package

 Requires one external capacitor

 PLL bypass operation facilitates board debug

process

 ESD greater than 2kV on all pins

FIGURE 1. BLOCK DIAGRAM OF XRT91L33A

STS12_MODE

REFCK

19.44 MHz

CAP+

1u F

PLL

RX LOOP

FILTER

CAP-

TEST

LVDS/LVPECL

Output Drivers

Differential

Receiver

RECVD-

DATAOUT

RXDOP

RXDIP

RXDATAIN

CDR

RXDIN

RXDON

STS-12/3

Internal

biasing

STM-4/1

Clock and Data

Recovery

External

100R

termination

RECVD-

CLKOUT

RXCLKOP

RXCLKON

LOCK

LCKTOREFN

SIGD

MUTE

RXDO

Exar Corporation 48720 Kato Road, Fremont CA, 94538 • (510) 668-7000 • FAX (510) 668-7017 • www.exar.com

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型号	品牌	获取价格	描述	数据表
XRT91L33IG	EXAR	获取价格	STS-12/STS-3 MULTIRATE CLOCK AND DATA RECOVERY UNIT
XRT91L33IG-F	EXAR	获取价格	STS-12/STS-3 MULTIRATE CLOCK AND DATA RECOVERY UNIT
XRT91L34	EXAR	获取价格	QUAD CHANNEL MULTIRATE STS-12/3/1 AND STM-4/1/0 SONET/SDH CDR
XRT91L34IV	EXAR	获取价格	QUAD CHANNEL MULTIRATE STS-12/3/1 AND STM-4/1/0 SONET/SDH CDR
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XRT91L80	EXAR	获取价格	2.488/2.666GBPS OC-48/STM-16 SONET/SDH TRANSCEIVER
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XRT91L81	EXAR	获取价格	2.488/2.666GBPS OC-48/STM-16 SONET/SDH TRANSCEIVER

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