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VSC8120

更新时间： 2024-02-20 20:31:21
品牌 Logo 应用领域
VITESSE ATM异步传输模式电信电信集成电路
页数 文件大小 规格书
10页 103K
描述
Clock Recovery Circuit, 1-Func, GAAS, PQFP64, 10 X 10 MM, PLASTIC, QFP-64

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VSC8120 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Transferred零件包装代码：QFP
包装说明：FQFP, QFP64,.51SQ,20针数：64
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.44应用程序：SONET;SDH
JESD-30 代码：S-PQFP-G64JESD-609代码：e0
长度：10 mm负电源额定电压：-5.2 V
功能数量：1端子数量：64
最高工作温度：85 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：FQFP
封装等效代码：QFP64,.51SQ,20封装形状：SQUARE
封装形式：FLATPACK, FINE PITCH峰值回流温度（摄氏度）：NOT SPECIFIED
电源：-5 V认证状态：Not Qualified
座面最大高度：2.45 mm子类别：ATM/SONET/SDH ICs
表面贴装：YES技术：GAAS
电信集成电路类型：ATM/SONET/SDH CLOCK RECOVERY CIRCUIT温度等级：OTHER
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：10 mm
Base Number Matches：1

VSC8120 数据手册

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VITESSE  
SEMICONDUCTOR CORPORATION  
Advance Product Information  
2.488 Gbit/sec SONET/SDH  
Clock and Data Recovery IC  
VSC8120  
Table 1: Reference Frequency  
Reference Frequency  
REF_SEL0  
REF_SEL1  
0
1
0
1
0
0
1
1
19.44MHz  
38.88MHz  
77.76MHz  
155.52MHz  
Retiming:  
The retiming decision circuit functions as a D Flip Flop. The recovered clock nominally clocks the deci-  
sion circuit in the center of the data eye. Internally, the recovered clock can be adjusted by +/-UI/2 in steps of  
UI/32. The PH_ADJ[0:4] inputs select the phase of the clock that is used to retime the data. Certain lightwave  
systems employing optical amplifiers suffer from noise in the leading edge of the data eye. Therefore these sys-  
tems may achieve their lowest Bit Error Rate (BER) by delaying the retiming point until later in the eye. These  
inputs can be strapped to generate a fixed delay or the customer can develop a dynamic circuit which can select  
the optimum retiming point during a training sequence. Refer to Table 2.  
Table 2: Retiming Phase Adjust Settings  
Degrees  
From Center  
PS From  
Center  
PH_ADJ4  
PH_ADJ3  
PH_ADJ2  
PH_ADJ1  
PH_ADJ0  
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0.00  
11.25  
0.0  
12.6  
22.50  
25.1  
33.75  
37.7  
45.00  
50.2  
56.25  
62.8  
67.50  
75.4  
78.75  
87.9  
90.00  
100.5  
113.0  
125.6  
138.2  
150.7  
163.3  
175.8  
188.4  
201.0  
-188.4  
-175.8  
-163.3  
101.25  
112.50  
123.75  
135.00  
146.25  
157.50  
168.75  
180.00  
-168.75  
-157.50  
-146.25  
G52151-0, Rev. 2.0  
10/2/98  
VITESSE SEMICONDUCTOR CORPORATION  
741 Calle Plano, Camarillo, CA 93012 • 805/388-3700 • FAX: 805/987-5896  
Page 3  
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 		Target Specification
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 		2.488 Gbit/sec 32:1 SONET/SDH Mux with Clock Generator

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