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TMS320C6203BGLSH

更新时间： 2024-10-27 19:56:31
品牌 Logo 应用领域
德州仪器 - TI 时钟外围集成电路
页数 文件大小 规格书
109页 1660K
描述
Fixed-Point Digital Signal Processor 384-FCBGA

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TMS320C6203BGLSH 技术参数

是否无铅： 含铅生命周期：Obsolete
零件包装代码：BGA包装说明：HFBGA, BGA384,22X22,32
针数：384Reach Compliance Code：unknown
ECCN代码：3A001.A.3HTS代码：8542.31.00.01
风险等级：5.62其他特性：ALSO REQUIRES 3.3V SUPPLY
地址总线宽度：22桶式移位器：NO
位大小：32边界扫描：YES
最大时钟频率：300 MHz外部数据总线宽度：32
格式：FIXED POINT内部总线架构：MULTIPLE
JESD-30 代码：S-PBGA-B384长度：18 mm
低功率模式：YES端子数量：384
封装主体材料：PLASTIC/EPOXY封装代码：HFBGA
封装等效代码：BGA384,22X22,32封装形状：SQUARE
封装形式：GRID ARRAY, HEAT SINK/SLUG, FINE PITCH电源：1.5,3.3 V
认证状态：Not QualifiedRAM（字数）：524288
座面最大高度：2.8 mm子类别：Digital Signal Processors
最大供电电压：1.57 V最小供电电压：1.43 V
标称供电电压：1.5 V表面贴装：YES
技术：CMOS端子形式：BALL
端子节距：0.8 mm端子位置：BOTTOM
宽度：18 mmuPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：1

TMS320C6203BGLSH 数据手册

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SPRS086N − JANUARY 1999 − REVISED JULY 2006  
D
D
High-Performance Fixed-Point Digital  
Signal Processor (DSP) − TMS320C62x  
− 4-, 3.33-ns Instruction Cycle Time  
− 250-, 300-MHz Clock Rate  
− Eight 32-Bit Instructions/Cycle  
− 2000, 2400 MIPS  
D
Four-Channel Bootloading  
Direct-Memory-Access (DMA) Controller  
With an Auxiliary Channel  
D
D
Flexible Phase-Locked-Loop (PLL) Clock  
Generator  
32-Bit Expansion Bus (XBus)  
− Glueless/Low-Glue Interface to Popular  
PCI Bridge Chips  
− Glueless/Low-Glue Interface to Popular  
Synchronous or Asynchronous  
Microprocessor Buses  
− Master/Slave Functionality  
− Glueless Interface to Synchronous FIFOs  
and Asynchronous Peripherals  
C6203B and C6202 GLS Ball Grid Array  
(BGA) Packages are Pin-Compatible With  
†
the C6204 GLW BGA Package  
D
D
C6203B and C6202B GNZ, GNY and ZNY  
Packages are Pin-Compatible  
VelociTIAdvanced Very-Long-Instruction-  
Word (VLIW) C62xDSP Core  
− Eight Highly Independent Functional  
Units:  
D
Three Multichannel Buffered Serial Ports  
(McBSPs)  
− Six ALUs (32-/40-Bit)  
− Two 16-Bit Multipliers (32-Bit Result)  
− Load-Store Architecture With 32 32-Bit  
General-Purpose Registers  
− Instruction Packing Reduces Code Size  
− All Instructions Conditional  
− Direct Interface to T1/E1, MVIP, SCSA  
Framers  
− ST-Bus-Switching Compatible  
− Up to 256 Channels Each  
− AC97-Compatible  
− Serial-Peripheral Interface (SPI)  
Compatible (Motorola)  
Two 32-Bit General-Purpose Timers  
D
D
D
Instruction Set Features  
− Byte-Addressable (8-, 16-, 32-Bit Data)  
− 8-Bit Overflow Protection  
− Saturation  
− Bit-Field Extract, Set, Clear  
− Bit-Counting  
D
D
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D
‡
IEEE-1149.1 (JTAG )  
Boundary-Scan-Compatible  
352-Pin BGA Package (GNZ)  
384-Pin BGA Package (GLS)  
384-Pin BGA Packages (GNY and ZNY)  
− Normalization  
7M-Bit On-Chip SRAM  
− 3M-Bit Internal Program/Cache  
(96K 32-Bit Instructions)  
− 4M-Bit Dual-Access Internal Data  
(512K Bytes)  
0.15-µm/5-Level Metal Process  
− CMOS Technology  
D
3.3-V I/Os, 1.5-V Internal  
− Organized as Two 256K-Byte Blocks  
for Improved Concurrency  
32-Bit External Memory Interface (EMIF)  
− Glueless Interface to Synchronous  
Memories: SDRAM or SBSRAM  
− Glueless Interface to Asynchronous  
Memories: SRAM and EPROM  
− 52M-Byte Addressable External Memory  
Space  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
TMS320C62x, VelociTI, and C62x are trademarks of Texas Instruments.  
Motorola is a trademark of Motorola, Inc.  
All trademarks are the property of their respective owners.  
†
‡
For more details, see the GLS BGA package bottom view.  
IEEE Standard 1149.1-1990 Standard-Test-Access Port and Boundary Scan Architecture.  
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Copyright 2006, Texas Instruments Incorporated  
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与TMS320C6203BGLSH相关器件

型号 品牌 获取价格 描述 数据表
TMS320C6203BGNY173 TI

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