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TMPR3927F PDF预览

TMPR3927F

更新时间： 2024-11-15 19:52:51
品牌 Logo 应用领域
东芝 - TOSHIBA 时钟外围集成电路
页数 文件大小 规格书
22页 266K
描述
IC 32-BIT, 133 MHz, RISC PROCESSOR, PQFP240, 32 X 32 MM, 0.50 MM PITCH, PLASTIC, QFP-240, Microprocessor

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TMPR3927F 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：32 X 32 MM, 0.50 MM PITCH, PLASTIC, QFP-240
针数：240Reach Compliance Code：unknown
风险等级：5.84地址总线宽度：20
位大小：32边界扫描：NO
最大时钟频率：66.66 MHz外部数据总线宽度：32
格式：FIXED POINT集成缓存：YES
JESD-30 代码：S-PQFP-G240长度：32 mm
低功率模式：NO端子数量：240
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：FQFP
封装形状：SQUARE封装形式：FLATPACK, FINE PITCH
峰值回流温度（摄氏度）：NOT SPECIFIED认证状态：Not Qualified
座面最大高度：4.45 mm速度：133 MHz
最大供电电压：3.6 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
温度等级：COMMERCIAL端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：32 mm
uPs/uCs/外围集成电路类型：MICROPROCESSOR, RISCBase Number Matches：1

TMPR3927F 数据手册

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TMPR3927F  
TENTATIVE  
TOSHIBA RISC PROCESSOR  
TMPR3927F  
(32-bit RISC MICROPROCESSOR)  
1. GENERAL DESCRIPTION  
The TMPR3927F (to be called “TX3927” hereinafter) is a standard micro controller of the 32-bit  
RISC Microprocessor TX39 family. The TX3927 uses the TX39/H2 processor core as the CPU.  
The TX39/H2 processor core is a RISC CPU core Toshiba developed based on the R3000A  
architecture of MIPS Technologies, Inc. The TX3927 has built-in peripheral circuits which include  
memory controllers, a PCI controller, DMA controller, serial and parallel ports, and timer/counters.  
2. FEATURES  
q TX39/H2 Processor Core  
·
The TX39/H2 is a high-performance 32-bit microprocessor core developed by Toshiba based  
on the R3000AÔ architecture.  
·
·
·
·
·
·
·
8kbytes of Instruction cache (2-way set associative)  
4kbytes of Data cache (2-way set associative)  
Cache support of burst refill and cache locking functions.  
Supports Critical Word First Mode  
Incorporates MMU with translation lookaside buffer (TLB)  
Single cycle, 32 x 32 bit MAC unit for DSP functions  
Built-in Debug Support Unit (DSU)  
q SDRAM Controller  
·
·
·
·
·
·
Supports 8 channels of SDRAM, Flash (DIMM), SGRAM, or SMROM memory  
Supports 16M/64M/128M/256M bit SDRAM with 2/4 bank size availability  
Support of 16/32-bit static bus sizing on a per channel basis  
Supports Single Data Rate (SDR) SDRAM  
Supports JEDEC standard 100-pin or 168-pin DIMM sockets for SDRAM  
Supports JEDEC standard 100-pin DIMM sockets for Flash  
q ROM Controller  
2
·
Supports 8 channels of ROM, Page Mode ROM, Mask ROM, EPROM, E PROM, SRAM, and  
Flash Memory and I/O devices.  
·
Supports memory sizes of 1M Byte to 1GByte per channel in 32-bit mode, and sizes of 1M Byte  
to 512M Byte per channel in 16-bit mode  
TAEC_rev4_11-Jan-2000 1/22  
1234567...22

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