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Datasheet > 逻辑 > 复用器/解复用器> SY100E171
SY100E171 PDF预览

SY100E171

更新时间： 2024-01-30 19:44:42
品牌 Logo 应用领域
麦瑞 - MICREL 转换器
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4页 63K
描述
3-BIT 4:1 MULTIPLEXER

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SY100E171 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：QLCC
包装说明：QCCJ, LDCC28,.5SQ针数：28
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.3系列：100E
JESD-30 代码：S-PQCC-J28JESD-609代码：e3
长度：11.48 mm逻辑集成电路类型：MULTIPLEXER
湿度敏感等级：2功能数量：3
输入次数：4输出次数：1
端子数量：28最高工作温度：85 °C
最低工作温度：输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC28,.5SQ封装形状：SQUARE
封装形式：CHIP CARRIER包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：-4.5 V
最大电源电流（ICC）：77 mAProp。Delay @ Nom-Sup：0.65 ns
传播延迟（tpd）：0.65 ns认证状态：Not Qualified
座面最大高度：4.57 mm子类别：Multiplexer/Demultiplexers
表面贴装：YES技术：ECL
温度等级：COMMERCIAL EXTENDED端子面层：Matte Tin (Sn)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：11.48 mmBase Number Matches：1

SY100E171 数据手册

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3-BIT 4:1  
MULTIPLEXER  
SY10E171  
SY100E171  
FEATURES  
DESCRIPTION  
■ 725ps max. D to output  
The SY10/100E171 offer three 4:1 multiplexers with  
differential outputs, designed for use in new, high-  
performance ECL systems. The leading 4-bit multiplexer  
operation is organized pairwise, with each pair being a 2-  
bit multiplexer. Separate select (SEL1A, SEL1B) controls  
are provided within each pair. The SEL1A and SEL1B  
signals control the leading multiplexers, while the SEL2  
signal controls the output multiplexer. The three select  
signals can be used to determine which of the four data  
inputs will be propagated to the corresponding outputs.  
■ Extended 100E VEE range of –4.2V to –5.5V  
■ Differential outputs  
■ Split select architecture  
■ Fully compatible with industry standard 10KH,  
100K ECL levels  
■ Internal 75KΩ input pulldown resistors  
■ Fully compatible with Motorola MC10E/100E171  
■ Available in 28-pin PLCC package  
BLOCK DIAGRAM  
PIN CONFIGURATION  
2:1  
MUX  
SEL  
D
0a  
0b  
D
2:1  
MUX  
SEL  
Q
0
0
25  
24 23 22 21 20 19  
Q
SEL1A  
SEL1B  
18  
17  
16  
15  
14  
13  
12  
26  
27  
28  
1
Q
Q
2
2
2:1  
MUX  
SEL  
D
0c  
D0d  
SEL  
2
V
CC  
TOP VIEW  
PLCC  
V
EE  
Q
Q
1
1
NC  
NC  
2
2:1  
MUX  
SEL  
D
1a  
1b  
J28-1  
3
V
CCO  
D
2:1  
MUX  
SEL  
Q
1
1
D
1c  
4
Q
0
5
6
7
8
9
10 11  
Q
2:1  
MUX  
SEL  
D
1c  
D1d  
2:1  
MUX  
SEL  
D
2a  
2b  
D
2:1  
MUX  
SEL  
Q
2
2
PIN NAMES  
Q
2:1  
MUX  
SEL  
D
2c  
Pin  
D0x–D2x  
SEL1A, SEL1B  
SEL2  
Function  
Data Inputs  
D2d  
First-stage Select Inputs  
Second-stage Select Input  
True Output  
SEL1A  
SEL1B  
Q0–Q2  
Q0–Q2  
Inverted Output  
SEL  
2
VCCO  
VCC to Output  
Rev.: C  
Amendment: /1  
Issue Date: February, 1998  
1
1234

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与SY100E171相关器件

型号 品牌 获取价格 描述 数据表
SY100E171JC MICREL

获取价格

 		3-BIT 4:1 MULTIPLEXER
SY100E171JCTR MICREL

获取价格

 		3-BIT 4:1 MULTIPLEXER
SY100E171JCTR MICROCHIP

获取价格

 		Multiplexer, 100E Series, 3-Func, 4 Line Input, 1 Line Output, Complementary Output, ECL,
SY100E171JZ MICREL

获取价格

 		3-BIT 4:1 MULTIPLEXER
SY100E171JZTR MICREL

获取价格

 		3-BIT 4:1 MULTIPLEXER
SY100E171JZTR MICROCHIP

获取价格

 		Multiplexer, 100E Series, 3-Func, 4 Line Input, 1 Line Output, Complementary Output, ECL,
SY100E175 MICREL

获取价格

 		9-BIT LATCH WITH PARITY
SY100E175JC MICREL

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 		9-BIT LATCH WITH PARITY
SY100E175JCTR MICREL

获取价格

 		9-BIT LATCH WITH PARITY
SY100E175JCTR MICROCHIP

获取价格

 		D Latch, 100E Series, 1-Func, Low Level Triggered, 9-Bit, True Output, ECL, PQCC28, PLASTI

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