5秒后页面跳转
捷配首页

Datasheet > 逻辑 > 触发器/锁存器> SN74ALS74ADG4
SN74ALS74ADG4 PDF预览

SN74ALS74ADG4

更新时间： 2024-11-24 05:17:47
品牌 Logo 应用领域
德州仪器 - TI 触发器锁存器逻辑集成电路光电二极管
页数 文件大小 规格书
18页 562K
描述
DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET

阅读下载

中文翻译

获取价格

SN74ALS74ADG4 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：GREEN, PLASTIC, SOIC-14针数：14
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.37
Is Samacsys：N系列：ALS
JESD-30 代码：R-PDSO-G14JESD-609代码：e4
长度：8.65 mm逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：34000000 Hz最大I（ol）：0.008 A
湿度敏感等级：1位数：1
功能数量：2端子数量：14
最高工作温度：70 °C最低工作温度：
输出极性：COMPLEMENTARY封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP14,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TUBE峰值回流温度（摄氏度）：260
电源：5 V最大电源电流（ICC）：4 mA
传播延迟（tpd）：18 ns认证状态：Not Qualified
座面最大高度：1.75 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：TTL温度等级：COMMERCIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：POSITIVE EDGE
宽度：3.9 mm最小 fmax：34 MHz
Base Number Matches：1

SN74ALS74ADG4 数据手册

 浏览型号SN74ALS74ADG4的Datasheet PDF文件第2页浏览型号SN74ALS74ADG4的Datasheet PDF文件第3页浏览型号SN74ALS74ADG4的Datasheet PDF文件第4页浏览型号SN74ALS74ADG4的Datasheet PDF文件第5页浏览型号SN74ALS74ADG4的Datasheet PDF文件第6页浏览型号SN74ALS74ADG4的Datasheet PDF文件第7页 
ꢀꢁꢂ ꢃ ꢄꢅ ꢀ ꢆꢃ ꢄꢇ ꢈ ꢀꢁꢂ ꢃ ꢄꢀꢆ ꢃ ꢄ ꢇꢈꢀ ꢁꢆ ꢃ ꢄꢅ ꢀꢆ ꢃ ꢄ ꢇꢈ ꢀꢁ ꢆꢃ ꢄꢀ ꢆꢃꢄ  
ꢉ ꢊꢄꢅꢈꢋ ꢌ ꢀꢍꢎ ꢍꢏ ꢐꢑꢐꢉ ꢒꢐ ꢑꢎ ꢓꢍꢒ ꢒ ꢐꢓꢐ ꢉꢈꢉ ꢑꢎ ꢔꢋꢐ ꢈꢕ ꢅꢍ ꢋ ꢑ ꢕꢅꢌ ꢋ ꢀ  
ꢖ ꢍꢎ ꢗꢈ ꢘꢅꢐ ꢄꢓꢈꢄꢁꢉꢈ ꢋ ꢓꢐ ꢀ ꢐꢎ  
SDAS143C − APRIL 1982 − REVISED AUGUST 1995  
SN54ALS74A, SN54AS74A . . . J PACKAGE  
SN74ALS74A, SN74AS74A . . . D OR N PACKAGE  
(TOP VIEW)  
• Package Options Include Plastic  
Small-Outline (D) Packages, Ceramic Chip  
Carriers (FK), and Standard Plastic (N) and  
Ceramic (J) 300-mil DIPs  
1CLR  
1D  
1CLK  
1PRE  
1Q  
V
CC  
2CLR  
1
2
3
4
5
6
7
14  
13  
12  
11  
10  
9
TYPICAL MAXIMUM  
CLOCK FREQUENCY  
TYPICAL POWER  
2D  
DISSIPATION  
PER FLIP-FLOP  
(mW)  
TYPE  
2CLK  
2PRE  
2Q  
(C = 50 pF)  
L
(MHz)  
50  
1Q  
GND  
′ALS74A  
′AS74A  
6
2Q  
8
134  
26  
description  
SN54ALS74A, SN54AS74A . . . FK PACKAGE  
(TOP VIEW)  
These devices contain two independent  
positive-edge-triggered D-type flip-flops. A low  
level at the preset (PRE) or clear (CLR) inputs sets  
or resets the outputs regardless of the levels of the  
other inputs. When PRE and CLR are inactive  
(high), data at the data (D) input meeting the  
setup-time requirements are transferred to the  
outputs on the positive-going edge of the clock  
(CLK) pulse. Clock triggering occurs at a voltage  
level and is not directly related to the rise time of  
CLK. Following the hold-time interval, data at the  
D input can be changed without affecting the  
levels at the outputs.  
3
2
1
20 19  
18  
1CLK  
NC  
2D  
17 NC  
4
5
6
7
8
16  
15  
14  
1PRE  
NC  
2CLK  
NC  
1Q  
2PRE  
9 10 11 12 13  
NC − No internal connection  
The SN54ALS74A and SN54AS74A are  
characterized for operation over the full military  
temperature range of −55°C to 125°C. The  
SN74ALS74A and SN74AS74A are characterized  
for operation from 0°C to 70°C.  
FUNCTION TABLE  
INPUTS  
OUTPUTS  
PRE  
L
CLR  
CLK  
X
D
X
X
X
H
L
Q
H
L
Q
L
H
L
H
X
H
†
†
H
L
L
X
H
H
H
H
H
↑
H
L
L
H
↑
H
H
L
X
Q
Q
0
0
†
The output levels in this configuration are not  
specified to meet the minimum levels for V if the  
OH  
lows at PRE and CLR are near V maximum.  
IL  
Furthermore, this configuration is nonstable; that  
is, it does not persist when PRE or CLR returns to  
its inactive (high) level.  
ꢋ
ꢋ
ꢓ
ꢌ
ꢨ
ꢉ
ꢣ
ꢊ
ꢘ
ꢡ
ꢎ
ꢢ
ꢍ
ꢜ
ꢌ
ꢚ
ꢁ
ꢛ
ꢉ
ꢄ
ꢎ
ꢄ
ꢙ
ꢚ
ꢤ
ꢛ
ꢜ
ꢢ
ꢝ
ꢞ
ꢟ
ꢟ
ꢠ
ꢠ
ꢙ
ꢙ
ꢜ
ꢜ
ꢚ
ꢚ
ꢙ
ꢡ
ꢡ
ꢥ
ꢢ
ꢣ
ꢝ
ꢝ
ꢤ
ꢤ
ꢚ
ꢠ
ꢟ
ꢞ
ꢡ
ꢡ
ꢜ
ꢛ
ꢥ
ꢎꢤ  
ꢣ
ꢦ
ꢡ
ꢧ
ꢙ
ꢢ
ꢟ
ꢡ
ꢠ
ꢙ
ꢠ
ꢜ
ꢝ
ꢚ
ꢣ
ꢨ
ꢟ
ꢚ
ꢠ
ꢠ
ꢤ
ꢡ
ꢩ
Copyright 1995, Texas Instruments Incorporated  
ꢝ
ꢜ
ꢢ
ꢠ
ꢜ
ꢝ
ꢞ
ꢠ
ꢜ
ꢡ
ꢥ
ꢙ
ꢛ
ꢙ
ꢢ
ꢤ
ꢝ
ꢠ
ꢪ
ꢠ
ꢤ
ꢝ
ꢜ
ꢛ
ꢫ
ꢟ
ꢍ
ꢚ
ꢞ
ꢤ
ꢡ
ꢠ
ꢟ
ꢚ
ꢨ
ꢟ
ꢝ
ꢨ
ꢬ
ꢟ
ꢠ ꢤ ꢡ ꢠꢙ ꢚꢮ ꢜꢛ ꢟ ꢧꢧ ꢥꢟ ꢝ ꢟ ꢞ ꢤ ꢠ ꢤ ꢝ ꢡ ꢩ  
ꢝ
ꢝ
ꢟ
ꢚ
ꢠ
ꢭ
ꢩ
ꢋ
ꢝ
ꢜ
ꢨ
ꢣ
ꢢ
ꢠ
ꢙ
ꢜ
ꢚ
ꢥ
ꢝ
ꢜ
ꢢ
ꢤ
ꢡ
ꢡ
ꢙ
ꢚ
ꢮ
ꢨ
ꢜ
ꢤ
ꢡ
ꢚ
ꢜ
ꢠ
ꢚ
ꢤ
ꢢ
ꢤ
ꢡ
ꢡ
ꢟ
ꢝ
ꢙ
ꢧ
ꢭ
ꢙ
ꢚ
ꢢ
ꢧ
ꢣ
ꢨ
ꢤ
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
1234567...18

中文翻译

下载PDF

与SN74ALS74ADG4相关器件

型号 品牌 获取价格 描述 数据表
SN74ALS74ADP3 TI

获取价格

 		IC,FLIP-FLOP,DUAL,D TYPE,ALS-TTL,SOP,14PIN,PLASTIC
SN74ALS74ADR TI

获取价格

 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74ADRE4 TI

获取价格

 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74ADRG4 TI

获取价格

 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74AFN TI

获取价格

 		暂无描述
SN74ALS74AFN3 TI

获取价格

 		IC,FLIP-FLOP,DUAL,D TYPE,ALS-TTL,LDCC,20PIN,PLASTIC
SN74ALS74AJ TI

获取价格

 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74AJ4 TI

获取价格

 		IC,FLIP-FLOP,DUAL,D TYPE,ALS-TTL,DIP,14PIN,CERAMIC
SN74ALS74AN TI

获取价格

 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74AN1 TI

获取价格

 		IC,FLIP-FLOP,DUAL,D TYPE,ALS-TTL,DIP,14PIN,PLASTIC

与SN74ALS74ADG4相关文章

您还可以找


热门产品
PCB打样/小批量
铝基板
BOM智能配单
PCBA制造
钣金
精密CNC
模具注塑
薄膜开关
精选活动
PCBA打样特惠
四六层板品质升级
铝基板品质升级
一体化电子制造
DFM下载
服务支持
企业认证
产品展示
工厂展示
工艺能力
积分商城
关于捷配
捷配简介
企业文化
公司动态
人才招聘
联系我们
帮助中心
下单流程
付款流程
开票流程
常见问题
全球PCB制造服务专线 400-613-0088

工作时间：9:00-21:00

CEO邮箱：ceo@jiepei.com

投诉邮箱：tousu@jiepei.com

捷配网-微信公众号 微信公众号
捷配网-微信公众号 抖音公众号
资质认证：
合作快递：
支付方式：
Copyright © 2024 Jiepei.com Inc. All Rights Reserved. 版权所有:杭州捷配信息科技有限公司 浙公网安备 33010502006866号 浙ICP备10014259号-119 营业执照ICP证