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SN74ALS74AFN

更新时间： 2024-11-24 12:59:23
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德州仪器 - TI 触发器
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SN74ALS74AFN 数据手册

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SDAS143C − APRIL 1982 − REVISED AUGUST 1995  
SN54ALS74A, SN54AS74A . . . J PACKAGE  
SN74ALS74A, SN74AS74A . . . D OR N PACKAGE  
(TOP VIEW)  
• Package Options Include Plastic  
Small-Outline (D) Packages, Ceramic Chip  
Carriers (FK), and Standard Plastic (N) and  
Ceramic (J) 300-mil DIPs  
1CLR  
1D  
1CLK  
1PRE  
1Q  
V
CC  
2CLR  
1
2
3
4
5
6
7
14  
13  
12  
11  
10  
9
TYPICAL MAXIMUM  
CLOCK FREQUENCY  
TYPICAL POWER  
2D  
DISSIPATION  
PER FLIP-FLOP  
(mW)  
TYPE  
2CLK  
2PRE  
2Q  
(C = 50 pF)  
L
(MHz)  
50  
1Q  
GND  
′ALS74A  
′AS74A  
6
2Q  
8
134  
26  
description  
SN54ALS74A, SN54AS74A . . . FK PACKAGE  
(TOP VIEW)  
These devices contain two independent  
positive-edge-triggered D-type flip-flops. A low  
level at the preset (PRE) or clear (CLR) inputs sets  
or resets the outputs regardless of the levels of the  
other inputs. When PRE and CLR are inactive  
(high), data at the data (D) input meeting the  
setup-time requirements are transferred to the  
outputs on the positive-going edge of the clock  
(CLK) pulse. Clock triggering occurs at a voltage  
level and is not directly related to the rise time of  
CLK. Following the hold-time interval, data at the  
D input can be changed without affecting the  
levels at the outputs.  
3
2
1
20 19  
18  
1CLK  
NC  
2D  
17 NC  
4
5
6
7
8
16  
15  
14  
1PRE  
NC  
2CLK  
NC  
1Q  
2PRE  
9 10 11 12 13  
NC − No internal connection  
The SN54ALS74A and SN54AS74A are  
characterized for operation over the full military  
temperature range of −55°C to 125°C. The  
SN74ALS74A and SN74AS74A are characterized  
for operation from 0°C to 70°C.  
FUNCTION TABLE  
INPUTS  
OUTPUTS  
PRE  
L
CLR  
CLK  
X
D
X
X
X
H
L
Q
H
L
Q
L
H
L
H
X
H
†
†
H
L
L
X
H
H
H
H
H
↑
H
L
L
H
↑
H
H
L
X
Q
Q
0
0
†
The output levels in this configuration are not  
specified to meet the minimum levels for V if the  
OH  
lows at PRE and CLR are near V maximum.  
IL  
Furthermore, this configuration is nonstable; that  
is, it does not persist when PRE or CLR returns to  
its inactive (high) level.  
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Copyright 1995, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
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与SN74ALS74AFN相关器件

型号 品牌 获取价格 描述 数据表
SN74ALS74AFN3 TI

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 		IC,FLIP-FLOP,DUAL,D TYPE,ALS-TTL,LDCC,20PIN,PLASTIC
SN74ALS74AJ TI

获取价格

 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74AJ4 TI

获取价格

 		IC,FLIP-FLOP,DUAL,D TYPE,ALS-TTL,DIP,14PIN,CERAMIC
SN74ALS74AN TI

获取价格

 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74AN1 TI

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 		IC,FLIP-FLOP,DUAL,D TYPE,ALS-TTL,DIP,14PIN,PLASTIC
SN74ALS74AN3 TI

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 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74ANE4 TI

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 		DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET
SN74ALS74ANP3 TI

获取价格

 		IC,FLIP-FLOP,DUAL,D TYPE,ALS-TTL,DIP,14PIN,PLASTIC
SN74ALS74ANS TI

获取价格

 		ALS SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14, PLASTI
SN74ALS74ANSE4 TI

获取价格

 		IC ALS SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14, PLA

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