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Datasheet > 逻辑 > 触发器/锁存器> SN54AS175J
SN54AS175J PDF预览

SN54AS175J

更新时间： 2024-11-27 13:13:43
品牌 Logo 应用领域
德州仪器 - TI 触发器
页数 文件大小 规格书
21页 598K
描述
AS SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CDIP16, CERAMIC, DIP-16

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SN54AS175J 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP, DIP16,.3
针数：16Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.65
系列：ASJESD-30 代码：R-GDIP-T16
长度：19.56 mm逻辑集成电路类型：D FLIP-FLOP
位数：4功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-55 °C输出极性：COMPLEMENTARY
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DIP
封装等效代码：DIP16,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 V传播延迟（tpd）：11.5 ns
认证状态：Not Qualified座面最大高度：5.08 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：TTL
温度等级：MILITARY端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：POSITIVE EDGE
宽度：7.62 mm最小 fmax：100 MHz
Base Number Matches：1

SN54AS175J 数据手册

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SN54ALS174, SN54ALS175, SN54AS174, SN54AS175B  
SN74ALS174, SN74ALS175, SN74AS174, SN74AS175B  
HEX/QUADRUPLE D-TYPE FLIP-FLOPS WITH CLEAR  
SDAS207E - APRIL 1982 - REVISED MAY 2002  
’ALS174 and ’AS174 Contain Six Flip-Flops  
With Single-Rail Outputs  
Applications Include:  
– Buffer/Storage Registers  
– Shift Registers  
’ALS175 and ’AS175B Contain Four  
Flip-Flops With Double-Rail Outputs  
– Pattern Generators  
Fully Buffered Outputs for Maximum  
Isolation From External Disturbances  
(’AS Only)  
Buffered Clock and Direct-Clear Inputs  
SN54ALS174 . . . J OR W PACKAGE  
SN54AS174 . . . J PACKAGE  
SN54ALS175 . . . J OR W PACKAGE  
SN54AS175B . . . J PACKAGE  
SN74ALS174, SN74AS174 . . . D , N, OR NS PACKAGE  
(TOP VIEW)  
SN74ALS175, SN74AS175B . . . D, N, OR NS PACKAGE  
(TOP VIEW)  
CLR  
1Q  
1Q  
1D  
2D  
2Q  
2Q  
GND  
V
CC  
CLR  
1Q  
1D  
2D  
2Q  
3D  
3Q  
GND  
V
CC  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
4Q  
4Q  
4D  
3D  
3Q  
3Q  
CLK  
6Q  
6D  
5D  
5Q  
4D  
4Q  
CLK  
SN54ALS174, SN54AS174 . . . FK PACKAGE  
(TOP VIEW)  
SN54ALS175 . . . FK PACKAGE  
(TOP VIEW)  
3
2
1
20 19  
18 6D  
3
2
1
20 19  
18 4Q  
1D  
2D  
NC  
2Q  
3D  
1Q  
1D  
NC  
2D  
2Q  
4
5
6
7
8
4
5
6
7
8
17  
16  
15  
14  
17  
16  
15  
14  
5D  
NC  
5Q  
4D  
4D  
NC  
3D  
3Q  
9 10 11 12 13  
9 10 11 12 13  
NC – No internal connection  
description  
These positive-edge-triggered flip-flops utilize TTL circuitry to implement D-type flip-flop logic. All have a  
direct-clear (CLR) input. The ’ALS175 and ’AS175B feature complementary outputs from each flip-flop.  
Information at the data (D) inputs meeting the setup-time requirements is transferred to the outputs on the  
positive-going edge of the clock pulse. Clock triggering occurs at a particular voltage level and is not directly  
related to the transition time of the positive-going pulse. When the clock (CLK) input is at either the high or low  
level, the D-input signal has no effect at the output.  
These circuits are fully compatible for use with most TTL circuits.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2002, Texas Instruments Incorporated  
On products compliant to MIL-PRF-38535, all parameters are tested  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
unless otherwise noted. On all other products, production  
testing of all parameters.  
processing does not necessarily include testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...21

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型号 品牌 获取价格 描述 数据表
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