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MCM6926AWJ12

更新时间: 2024-11-10 15:41:11
品牌 Logo 应用领域
恩智浦 - NXP 信息通信管理静态存储器光电二极管内存集成电路
页数 文件大小 规格书
8页 252K
描述
IC,SRAM,128KX8,BICMOS-TTL,SOJ,32PIN,PLASTIC

MCM6926AWJ12 技术参数

是否Rohs认证: 不符合生命周期:Transferred
零件包装代码:SOJ包装说明:SOJ, SOJ32,.44
针数:32Reach Compliance Code:unknown
ECCN代码:3A991HTS代码:8542.31.00.01
风险等级:5.24最长访问时间:12 ns
I/O 类型:COMMONJESD-30 代码:R-PDSO-J32
长度:20.55 mm内存密度:1048576 bit
内存集成电路类型:STANDARD SRAM内存宽度:8
功能数量:1端子数量:32
字数:131072 words字数代码:128000
工作模式:SYNCHRONOUS最高工作温度:70 °C
最低工作温度:组织:128KX8
输出特性:3-STATE封装主体材料:PLASTIC/EPOXY
封装代码:SOJ封装等效代码:SOJ32,.44
封装形状:RECTANGULAR封装形式:SMALL OUTLINE
并行/串行:PARALLEL电源:3.3 V
认证状态:Not Qualified座面最大高度:3.75 mm
最大待机电流:0.02 A最小待机电流:3.14 V
子类别:SRAMs最大压摆率:0.1 mA
最大供电电压 (Vsup):3.6 V最小供电电压 (Vsup):3.135 V
标称供电电压 (Vsup):3.3 V表面贴装:YES
技术:BICMOS温度等级:COMMERCIAL
端子形式:J BEND端子节距:1.27 mm
端子位置:DUAL宽度:10.16 mm
Base Number Matches:1

MCM6926AWJ12 数据手册

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Freescale Semiconductor, Inc.  
SEMICONDUCTOR TECHNICAL DATA  
Order this document  
by MCM6926A/D  
MCM6926A  
Advance Information  
128K x 8 Bit Fast Static Random  
Access Memory  
The MCM6926A is a 1,048,576 bit static random access memory organized  
as 131,072 words of 8 bits. Static design eliminates the need for external clocks  
or timing strobes.  
WJ PACKAGE  
400 MIL SOJ  
CASE 857A–02  
Output enable (G) is a special control feature that provides increased system  
flexibility and eliminates bus contention problems.  
This device meets JEDEC standards for functionality and revolutionary pinout,  
and is available in a 400 mil plastic small–outline J–leaded package.  
PIN ASSIGNMENT  
A
A
1
2
32  
31  
A
A
Single 3.3 V Power Supply  
Fully Static — No Clock or Timing Strobes Necessary  
All Inputs and Outputs Are TTL Compatible  
Three State Outputs  
Fast Access Times: 8, 10, 12, 15 ns  
Center Power and I/O Pins for Reduced Noise  
Fully 3.3 V BiCMOS  
A
A
3
4
30  
29  
A
A
E
5
6
28  
G
DQ  
27 DQ  
26 DQ  
DQ  
7
8
V
25  
24  
V
SS  
DD  
BLOCK DIAGRAM  
V
V
DD  
9
SS  
DQ  
10  
23 DQ  
22 DQ  
A
A
A
V
V
DD  
SS  
DQ  
W
11  
12  
21  
20  
19  
18  
A
A
A
A
A
A
A
13  
14  
15  
A
MEMORY  
ROW  
DECODER  
MATRIX  
512 ROWS x 256 x 8  
COLUMNS  
A
A
A
A
A
A
16  
17  
A
PIN NAMES  
DQ  
COLUMN I/O  
A . . . . . . . . . . . . . . . . . . . . . . . Address Input  
E . . . . . . . . . . . . . . . . . . . . . . . . Chip Enable  
W . . . . . . . . . . . . . . . . . . . . . . . Write Enable  
G . . . . . . . . . . . . . . . . . . . . . . Output Enable  
DQ . . . . . . . . . . . . . . . . . . Data Input/Output  
INPUT  
DATA  
CONTROL  
COLUMN DECODER  
DQ  
A
A
A
A
A
A
A
A
V
DD  
V
SS  
. . . . . . . . . . . . . + 3.3 V Power Supply  
. . . . . . . . . . . . . . . . . . . . . . . . . . Ground  
E
W
G
This document contains information on a new product. Motorola reserves the right to change or discontinue this product without notice.  
REV 2  
8/14/98  
Motorola, Inc. 1998  
For More Information On This Product,  
Go to: www.freescale.com  

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