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MC74HC373AFL2 PDF预览

MC74HC373AFL2

更新时间： 2024-11-28 20:07:55
品牌 Logo 应用领域
安森美 - ONSEMI 光电二极管逻辑集成电路
页数 文件大小 规格书
8页 113K
描述
IC,LATCH,SINGLE,8-BIT,HC-CMOS,SOP,20PIN,PLASTIC

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MC74HC373AFL2 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：SOP, SOP20,.3Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.92
JESD-30 代码：R-PDSO-G20JESD-609代码：e0
负载电容（CL）：50 pF逻辑集成电路类型：D LATCH
最大I（ol）：0.006 A位数：8
功能数量：1端子数量：20
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP20,.3
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TAPE AND REEL电源：2/6 V
Prop。Delay @ Nom-Sup：38 ns认证状态：Not Qualified
子类别：FF/Latches表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
Base Number Matches：1

MC74HC373AFL2 数据手册

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MC74HC373A  
Octal 3-State Non-Inverting  
Transparent Latch  
High–Performance Silicon–Gate CMOS  
The MC74HC373A is identical in pinout to the LS373. The device  
inputs are compatible with standard CMOS outputs; with pullup  
resistors, they are compatible with LSTTL outputs.  
http://onsemi.com  
These latches appear transparent to data (i.e., the outputs change  
asynchronously) when Latch Enable is high. When Latch Enable goes  
low, data meeting the setup and hold time becomes latched.  
The Output Enable input does not affect the state of the latches, but  
when Output Enable is high, all device outputs are forced to the  
high–impedance state. Thus, data may be latched even when the  
outputs are not enabled.  
MARKING  
DIAGRAMS  
20  
PDIP–20  
N SUFFIX  
CASE 738  
MC74HC373AN  
AWLYYWW  
20  
1
1
The HC373A is identical in function to the HC573A which has the  
data inputs on the opposite side of the package from the outputs to  
facilitate PC board layout.  
20  
SOIC WIDE–20  
DW SUFFIX  
CASE 751D  
HC373A  
AWLYYWW  
20  
1
The HC373A is the non–inverting version of the HC533A.  
1
20  
• Output Drive Capability: 15 LSTTL Loads  
• Outputs Directly Interface to CMOS, NMOS and TTL  
• Operating Voltage Range: 2.0 to 6.0 V  
• Low Input Current: 1.0 µA  
• High Noise Immunity Characteristic of CMOS Devices  
HC  
373A  
ALYW  
TSSOP–20  
DT SUFFIX  
CASE 948E  
20  
1
1
20  
• In Compliance with the Requirements Defined by JEDEC Standard  
No. 7A  
SOEIAJ–20  
F SUFFIX  
CASE 967  
74HC373A  
AWLYWW  
20  
• Chip Complexity: 186 FETs or 46.5 Equivalent Gates  
1
1
A
= Assembly Location  
WL = Wafer Lot  
YY = Year  
WW = Work Week  
ORDERING INFORMATION  
Device  
Package  
PDIP–20  
Shipping  
1440 / Box  
38 / Rail  
MC74HC373AN  
MC74HC373ADW  
MC74HC373ADWR2  
MC74HC373ADT  
MC74HC373ADTR2  
MC74HC373AF  
SOIC–WIDE  
SOIC–WIDE 1000 / Reel  
TSSOP–20 75 / Rail  
TSSOP–20 2500 / Reel  
SOEIAJ–20 1600 / Box  
SOEIAJ–20 2000 / Reel  
MC74HC373AFEL  
Semiconductor Components Industries, LLC, 2001  
1
Publication Order Number:  
November, 2001 – Rev. 10  
MC74HC373A/D  
12345678

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