MC74HC112ANG

更新时间： 2024-11-21 11:07:59

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安森美 - ONSEMI		触发器栅
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8页	171K
描述
Dual J-K Flip-Flop with Set and Reset High−Performance Silicon−Gate CMOS

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MC74HC112ANG 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	DIP	包装说明：	DIP, DIP16,.3
针数：	16	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.64
系列：	HC/UH	JESD-30 代码：	R-PDIP-T16
长度：	19.175 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	J-K FLIP-FLOP	最大频率@ Nom-Sup：	20000000 Hz
最大I（ol）：	0.004 A	位数：	2
功能数量：	2	端子数量：	16
最高工作温度：	125 °C	最低工作温度：	-55 °C
输出极性：	COMPLEMENTARY	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装等效代码：	DIP16,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
包装方法：	RAIL	电源：	2/6 V
认证状态：	Not Qualified	座面最大高度：	4.44 mm
子类别：	FF/Latches	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	技术：	CMOS
温度等级：	MILITARY	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
触发器类型：	NEGATIVE EDGE	宽度：	7.62 mm
Base Number Matches：	1

MC74HC112ANG 数据手册

MC74HC112A

Dual J-K Flip-Flop with

Set and Reset

High−Performance Silicon−Gate CMOS

The MC74HC112A is identical in pinout to the LS112. The device

inputs are compatible with standard CMOS outputs; with pullup

resistors, they are compatible with LSTTL outputs.

Each flip−flop is negative−edge clocked and has active−low

asynchronous Set and Reset inputs.

http://onsemi.com

MARKING

DIAGRAMS

The HC112A is identical in function to the HC76, but has a different

pinout.

PDIP−16

N SUFFIX

CASE 648

MC74HC112AN

AWLYYWWG

Features

• Output Drive Capability: 10 LSTTL Loads

• Outputs Directly Interface to CMOS, NMOS, and TTL

• Operating Voltage Range: 2.0 to 6.0 V

• Low Input Current: 1.0 mA

• High Noise Immunity Characteristic of CMOS Devices

• In Compliance with the Requirements Defined by JEDEC Standard

No. 7A

SOIC−16

D SUFFIX

CASE 751B

HC112AG

AWLYWW

• Similar in Function to the LS112 Except When Set and Reset are

Low Simultaneously

• Chip Complexity: 100 FETs or 25 Equivalent Gates

• Pb−Free Packages are Available*

TSSOP−16

DT SUFFIX

CASE 948F

112A

ALYWG

SOEIAJ−16

F SUFFIX

CASE 966

74HC112A

ALYWG

L, WL

Y, YY

= Assembly Location

= Wafer Lot

= Year

W, WW = Work Week

= Pb−Free Package

(Note: Microdot may be in either location)

ORDERING INFORMATION

See detailed ordering and shipping information in the package

dimensions section on page 2 of this data sheet.

*For additional information on our Pb−Free strategy and soldering details, please

download the ON Semiconductor Soldering and Mounting Techniques

Reference Manual, SOLDERRM/D.

Publication Order Number:

December, 2009 − Rev. 7

MC74HC112/D

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型号	品牌	获取价格	描述	数据表
MC74HC112D	MOTOROLA	获取价格	Dual J-K Flip-Flop with Set and Reset
MC74HC112DD	MOTOROLA	获取价格	J-K Flip-Flop, 2-Func, Negative Edge Triggered, CMOS, PDSO16
MC74HC112DDS	MOTOROLA	获取价格	暂无描述
MC74HC112DR2	MOTOROLA	获取价格	HC/UH SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16, PL
MC74HC112DS	MOTOROLA	获取价格	J-K Flip-Flop, 2-Func, Negative Edge Triggered, CMOS, PDSO16
MC74HC112DT	MOTOROLA	获取价格	Dual J-K Flip-Flop with Set and Reset
MC74HC112DTR2	MOTOROLA	获取价格	HC/UH SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16, PL
MC74HC112J	MOTOROLA	获取价格	IC,FLIP-FLOP,DUAL,J/K TYPE,HC-CMOS,DIP,16PIN,CERAMIC
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