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Datasheet > 微控制器和处理器 > 计时器或实时时钟> MC14536BDWR2G
MC14536BDWR2G PDF预览

MC14536BDWR2G

更新时间： 2024-02-07 01:19:40
品牌 Logo 应用领域
安森美 - ONSEMI 计时器或实时时钟微控制器和处理器外围集成电路光电二极管PC
页数 文件大小 规格书
14页 150K
描述
Programmable Timer

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MC14536BDWR2G 技术参数

是否无铅：不含铅生命周期：Active
零件包装代码：SOIC包装说明：SOP,
针数：16Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：0.54
Samacsys Confidence：3Samacsys Status：Released
Samacsys PartID：225196Samacsys Pin Count：16
Samacsys Part Category：Integrated CircuitSamacsys Package Category：Small Outline Packages
Samacsys Footprint Name：SOIC-16 WB CASE 751G-03 ISSUE DSamacsys Released Date：2015-08-07 09:42:55
Is Samacsys：N最大时钟频率：2 MHz
JESD-30 代码：R-PDSO-G16JESD-609代码：e3
长度：10.3 mm湿度敏感等级：3
端子数量：16计时器数量：1
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：2.65 mm最大供电电压：18 V
最小供电电压：3 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：7.5 mmuPs/uCs/外围集成电路类型：TIMER, PROGRAMMABLE
Base Number Matches：1

MC14536BDWR2G 数据手册

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MC14536B  
V
DD  
0.01 mF  
I
D
500 mF  
CERAMIC  
SET  
20 ns  
20 ns  
RESET OUT 1  
8−BYPASS  
C
L
V
DD  
IN  
50%  
1
PULSE  
IN  
1
GENERATOR  
t
t
WH  
WL  
C INH  
SET  
OUT 1  
OUT  
2
MONO−IN  
RESET  
90%  
10%  
50%  
t
OUT  
t
OSC INH  
C
L
C
L
8−BYPASS  
IN  
PULSE  
GENERATOR  
A
B
1
PHL  
PLH  
t
t
THL  
C INH  
TLH  
C
D
DECODE  
OUT  
OUT  
2
MONO−IN  
OSC INH  
A
B
V
SS  
C
D
DECODE  
OUT  
20 ns  
20 ns  
C
L
V
90%  
10%  
SS  
50%  
50%  
DUTY CYCLE  
Figure 8. Power Dissipation Test  
Circuit and Waveform  
Figure 9. Switching Time Test Circuit and Waveforms  
V
DD  
FUNCTIONAL TEST SEQUENCE  
Test function (Figure 10) has been included for the  
reduction of test time required to exercise all 24 counter  
stages. This test function divides the counter into three  
8−stage sections and 255 counts are loaded in each of the  
8−stage sections in parallel. All flip−flops are now at a “1”.  
The counter is now returned to the normal 24−stages in  
SET  
RESET OUT 1  
8−BYPASS  
PULSE  
GENERATOR  
IN  
1
C INH  
OUT  
2
MONO−IN  
OSC INH  
A
B
series configuration. One more pulse is entered into In  
1
which will cause the counter to ripple from an all “1” state  
to an all “0” state.  
C
D
DECODE  
OUT  
V
SS  
Figure 10. Functional  
Test Circuit  
FUNCTIONAL TEST SEQUENCE  
Inputs  
Outputs  
Comments  
Decade Out  
Q1 thru Q24  
In  
Set  
0
Reset  
8−Bypass  
1
All 24 stages are in Reset mode.  
1
1
0
1
1
1
1
1
1
0
0
0
1
Counter is in three 8 stage sections in parallel mode.  
First “1” to “0” transition of clock.  
1
1
0
−
−
−
1
1
1
255 “1” to “0” transitions are clocked in the counter.  
0
0
1
0
1
0
1
0
1
1
The 255 “1” to “0” transition.  
Counter converted back to 24 stages in series mode.  
Set and Reset must be connected together and simultaneously  
go from “1” to “0”.  
1
0
0
0
0
0
0
0
1
0
In Switches to a “1”.  
1
Counter Ripples from an all “1” state to an all “0” state.  
http://onsemi.com  
8
 
1...567891011...14

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