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Datasheet > 逻辑 > 触发器/锁存器> MC100EP51DTG
MC100EP51DTG PDF预览

MC100EP51DTG

更新时间： 2024-01-29 21:21:33
品牌 Logo 应用领域
安森美 - ONSEMI 触发器锁存器逻辑集成电路光电二极管时钟
页数 文件大小 规格书
11页 155K
描述
3.3V / 5V ECL D Flip−Flop with Reset and Differential Clock

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MC100EP51DTG 技术参数

是否无铅： 不含铅生命周期：Active
零件包装代码：SOIC包装说明：TSSOP, TSSOP8,.19
针数：8Reach Compliance Code：compliant
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：1.08其他特性：NECL MODE: VCC = 0V WITH VEE = -3V TO -5.5V
系列：100EJESD-30 代码：S-PDSO-G8
JESD-609代码：e3长度：3 mm
逻辑集成电路类型：D FLIP-FLOP最大频率@ Nom-Sup：3000000000 Hz
湿度敏感等级：3位数：1
功能数量：1端子数量：8
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：COMPLEMENTARY封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP8,.19
封装形状：SQUARE封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：RAIL峰值回流温度（摄氏度）：260
电源：-4.5 V最大电源电流（ICC）：47 mA
Prop。Delay @ Nom-Sup：0.5 ns传播延迟（tpd）：0.45 ns
认证状态：Not Qualified座面最大高度：1.1 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：ECL
温度等级：INDUSTRIAL端子面层：Tin (Sn)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
触发器类型：POSITIVE EDGE宽度：3 mm
Base Number Matches：1

MC100EP51DTG 数据手册

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MC10EP51, MC100EP51  
3.3V / 5VꢀECL D Flip−Flop  
with Reset and Differential  
Clock  
Description  
http://onsemi.com  
MARKING DIAGRAMS*  
The MC10/100EP51 is a differential clock D flip−flop with reset.  
The device is functionally equivalent to the EL51 and LVEL51  
devices.  
The reset input is an asynchronous, level triggered signal. Data  
enters the master portion of the flip−flop when the clock is LOW and is  
transferred to the slave, and thus the outputs, upon a positive transition  
of the clock. The differential clock inputs of the EP51 allow the device  
to be used as a negative edge triggered flip-flop.  
8
8
8
HEP51  
ALYW  
G
KEP51  
ALYW  
G
1
SOIC−8  
D SUFFIX  
CASE 751  
1
1
The differential input employs clamp circuitry to maintain stability  
under open input conditions. When left open, the CLK input will be  
pulled down to V and the CLK input will be biased at V /2.  
EE  
CC  
The 100 Series contains temperature compensation.  
8
1
8
1
8
1
HP51  
KP51  
Features  
ALYWG  
ALYWG  
• 350 ps Typical Propagation Delay  
• Maximum Frequency > 3 GHz Typical  
TSSOP−8  
DT SUFFIX  
CASE 948R  
G
G
• PECL Mode Operating Range: V = 3.0 V to 5.5 V  
CC  
with V = 0 V  
EE  
• NECL Mode Operating Range: V = 0 V  
CC  
with V = −3.0 V to −5.5 V  
EE  
• Open Input Default State  
• Safety Clamp on Inputs  
• Pb−Free Packages are Available  
1
4
1
4
DFN8  
MN SUFFIX  
CASE 506AA  
H
K
= MC10  
= MC100  
A
L
= Assembly Location  
= Wafer Lot  
5S = MC10  
3N = MC100  
Y
W
G
= Year  
= Work Week  
= Pb−Free Package  
M
= Date Code  
(Note: Microdot may be in either location)  
*For additional marking information, refer to  
Application Note AND8002/D.  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 8 of this data sheet.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
November, 2006 − Rev. 6  
MC10EP51/D  
1234567...11

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MC100EP51DTG 替代型号

型号 品牌 替代类型 描述 数据表
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类似代替

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型号 品牌 获取价格 描述 数据表
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 		3.3V / 5V ECL Differential Data and Clock D Flip−Flop
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