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Datasheet > 逻辑 > 触发器/锁存器> MC100E256FN
MC100E256FN PDF预览

MC100E256FN

更新时间： 2024-09-28 22:46:23
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 触发器锁存器逻辑集成电路
页数 文件大小 规格书
5页 113K
描述
3-BIT 4:1 MUX-LATCH

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MC100E256FN 技术参数

生命周期：Transferred零件包装代码：QLCC
包装说明：QCCJ, LDCC28,.5SQ针数：28
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.37其他特性：THREE 4:1 MUX FOLLOWED BY LATCH
系列：100EJESD-30 代码：S-PQCC-J28
JESD-609代码：e0长度：11.505 mm
逻辑集成电路类型：D LATCH位数：3
功能数量：1输入次数：4
端子数量：28最高工作温度：85 °C
最低工作温度：输出特性：OPEN-EMITTER
输出极性：COMPLEMENTARY封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装等效代码：LDCC28,.5SQ
封装形状：SQUARE封装形式：CHIP CARRIER
电源：-4.5 V最大电源电流（ICC）：96 mA
Prop。Delay @ Nom-Sup：0.9 ns传播延迟（tpd）：0.8 ns
认证状态：Not Qualified座面最大高度：4.57 mm
子类别：Multiplexer/Demultiplexers表面贴装：YES
技术：ECL温度等级：OTHER
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
触发器类型：LOW LEVEL宽度：11.505 mm
Base Number Matches：1

MC100E256FN 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
The MC10E/100E256 contains three 4:1 multiplexers followed by  
transparent latches with differential outputs. Separate Select controls are  
provided for the leading 2:1 mux pairs (see logic symbol).  
When the Latch Enable (LEN) is LOW, the latch is transparent, and  
output data is controlled by the multiplexer select controls. A logic HIGH  
on LEN latches the outputs. The Master Reset (MR) overrides all other  
controls to set the Q outputs LOW.  
3-BIT 4:1  
MUX-LATCH  
• 950ps Max. D to Output  
• 850ps Max. LEN to Output  
• Split Select  
• Differential Outputs  
• Extended 100E V  
Range of – 4.2V to – 5.46V  
• 75kΩ Input Pulldown Resistors  
EE  
Pinout: 28-Lead PLCC (Top View)  
D
D
D
D
D
D
V
CCO  
1b  
1a  
2d  
2c  
2b  
2a  
FN SUFFIX  
PLASTIC PACKAGE  
CASE 776-02  
25  
24  
23  
22  
21  
20  
19  
18  
SEL1A  
SEL1B  
SEL2  
26  
27  
28  
1
Q
Q
2
17  
16  
15  
14  
13  
2
V
CC  
V
Q
Q
EE  
1
LEN  
MR  
2
1
3
V
CCO  
D
4
12  
11  
Q
0
1c  
5
6
7
8
9
10  
D
D
D
D
D
V
Q
0
1d  
0a  
0b  
0c  
0d  
CCO  
* All V  
and V  
pins are tied together on the die.  
CC  
CCO  
FUNCTION TABLE  
PIN NAMES  
Pin  
Function  
Pin  
State  
Operation  
D
– D  
Data Inputs  
SEL2  
SEL1A  
SEL1B  
H
H
H
Output c/d Data  
Input d Data  
Input b Data  
0x  
2x  
SEL1A, SEL1B  
First-stage Select Inputs  
Second-stage Select input  
Latch Enable  
SEL2  
LEN  
MR  
Master Reset  
Q , Q – Q , Q  
Data Outputs  
0
0
2
2
12/93  
Motorola, Inc. 1996  
REV 2  
12345

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与MC100E256FN相关器件

型号 品牌 获取价格 描述 数据表
MC100E256FNR2 MOTOROLA

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 		100E SERIES, LOW LEVEL TRIGGERED D LATCH, COMPLEMENTARY OUTPUT, PQCC28, PLASTIC, LCC-28
MC100E256FNR2 ONSEMI

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 		100E SERIES, LOW LEVEL TRIGGERED D LATCH, COMPLEMENTARY OUTPUT, PQCC28, PLASTIC, LCC-28
MC100E310 ONSEMI

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 		5V ECL Low Voltage 2:8 Differential Fanout Buffer
MC100E310FN ONSEMI

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 		5V ECL Low Voltage 2:8 Differential Fanout Buffer
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