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M66305AFP

更新时间： 2024-11-24 22:46:35
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三菱 - MITSUBISHI 存储内存集成电路光电二极管
页数 文件大小 规格书
10页 89K
描述
TOGGLE LINE BUFFER

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M66305AFP 技术参数

是否Rohs认证：不符合生命周期：Transferred
零件包装代码：SOIC包装说明：SOP, SOP24,.5
针数：24Reach Compliance Code：unknown
HTS代码：8542.32.00.71风险等级：5.27
Is Samacsys：N最长访问时间：36 ns
JESD-30 代码：R-PDSO-G24JESD-609代码：e0
长度：15 mm内存密度：5120 bit
内存集成电路类型：MEMORY CIRCUIT内存宽度：1
功能数量：1端子数量：24
字数：5120 words字数代码：5000
工作模式：SYNCHRONOUS最高工作温度：70 °C
最低工作温度：-10 °C组织：5KX1
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP24,.5封装形状：RECTANGULAR
封装形式：SMALL OUTLINE电源：5 V
认证状态：Not Qualified座面最大高度：2.4 mm
子类别：Other Memory ICs最大压摆率：0.13 mA
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：8.4 mmBase Number Matches：1

M66305AFP 数据手册

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MITSUBISHI DIGITALASSP
M66305AP/AFP
TOGGLE LINE BUFFER  
DESCRIPTION  
PIN CONFIGURATION (TOP VIEW)  
M66305A Toggle Line Buffer has two 5,120-bit line buffer  
memories. It takes in serial data that arrives synchronously  
with clock pulses and outputs it in serial at a rate of up to 10  
Mbits per second synchronously with external clock pulses.  
This buffer employs the double buffer system: While data is  
being output, data on the next line can be written on the other  
line buffer memory.  
GND  
1
20  
19  
18  
VCC  
INPUT CLOCK SICLK  
2
SODATA OUTPUT DATA  
SOCLK OUTPUT CLOCK  
INPUT DATA SIDATA  
INPUT CLOCK ENABLE ICE  
CASCADE INPUT 1 CAS1  
GND  
3
4
5
6
7
8
9
17 OCE  
OUTPUT CLOCK ENABLE  
16 CAS2 CASCADE INPUT 2  
15  
14  
13  
CNTRST2 READ COUNTER RESET INPUT  
CNTRST1 WRITE COUNTER RESET INPUT  
FEATURES  
TOGGLE SIGNAL INPUT  
T
• 5,120 × 1bit serial input-serial output line buffer memories  
• Data transmission at 10 megabits/second maximum  
• Two line buffer memories can be alternated by external  
toggle signal.  
CHIP SELECT INPUT  
CS  
V
CC  
(5V)  
RESET INPUT RESET  
12 BF  
11 INT  
BUFFER FULL OUTPUT  
WRITE REQUEST OUTPUT  
GND 10  
• Memory capacity can be doubled by cascade connection.  
• Because of cascade input pin (CAS1), output potential after  
completion of output can be set to either H or L.  
• Low noise and high fan-out output (IO = ±24mA guaranteed)  
• Every input pin has built-in Schmidt trigger circuit.  
• Read counter and write counter can be reset independently.  
• RESET, T, CNTRST1 and CNTRST2 are equipped with  
negative noise reduction circuit.  
Outline 20P4  
GND  
INPUT CLOCK SICLK  
INPUT DATA SIDATA  
INPUT CLOCK ENABLE ICE  
CASCADE INPUT 1 CAS1  
NC  
1
24  
23  
VCC  
2
SODATA OUTPUT DATA  
SOCLK OUTPUT CLOCK  
3
4
5
6
7
8
9
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
OCE  
OUTPUT CLOCK ENABLE  
CAS2 CASCADE INPUT 2  
NC  
APPLICATION  
Data buffer between industrial or home-use image data pro-  
cessing system and peripheral equipment  
NC  
NC  
GND  
CNTRST2 READ COUNTER RESET INPUT  
CNTRST1 WRITE COUNTER RESET INPUT  
TOGGLE SIGNAL INPUT  
CHIP SELECT INPUT  
T
CS 10  
VCC  
(5V)  
RESET INPUT RESET 11  
BF  
BUFFER FULL OUTPUT  
WRITE REQUEST OUTPUT  
GND 12  
INT  
Outline 24P2W-A  
NC: No Connection  
BLOCK DIAGRAM  
Matching  
detection circuit  
WRITE REQUEST  
OUTPUT  
INT  
CHIP SELECT  
CS  
INPUT  
OUTPUT CLOCK  
ENABLE  
OCE  
RESET INPUT RESET  
Read counter  
AD  
DI  
S-RAM  
SOCLK OUTPUT CLOCK  
SODATA OUTPUT DATA  
WRITE COUNTER  
5120 bits  
CNTRST1  
RESET INPUT  
D0  
WR  
Data  
buffer  
Write register  
READ COUNTER  
RESET INPUT  
CNTRST2  
Write counter  
AD  
DI  
S-RAM  
INPUT DATA SIDATA  
5120 bits  
D0  
CASCADE INPUT 1 CAS1  
WR  
BUFFER FULL  
OUTPUT  
BF  
INPUT CLOCK SICLK  
INPUT CLOCK  
ICE  
Switch  
and P.G.  
ENABLE  
Toggle F/F  
TOGGLE SIGNAL  
T
INPUT  
1
1234567...10

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型号 品牌 获取价格 描述 数据表
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