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L9A0212

更新时间： 2024-02-26 07:53:39

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LSI		微处理器
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32页	330K
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Microprocessor

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L9A0212 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Transferred	零件包装代码：	BGA
包装说明：	BGA,	针数：	256
Reach Compliance Code：	compliant	ECCN代码：	3A001.A.3
HTS代码：	8542.31.00.01	风险等级：	5.88
其他特性：	ALSO OPERATES AT 1.8V SUPPLY AT 50 MHZ	地址总线宽度：
位大小：	32	边界扫描：	YES
最大时钟频率：	85 MHz	外部数据总线宽度：
格式：	FIXED POINT	集成缓存：	YES
JESD-30 代码：	S-PBGA-B256	JESD-609代码：	e0
长度：	27 mm	低功率模式：	YES
端子数量：	256	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	BGA	封装形状：	SQUARE
封装形式：	GRID ARRAY	峰值回流温度（摄氏度）：	225
认证状态：	Not Qualified	座面最大高度：	2.3 mm
速度：	85 MHz	最大供电电压：	2.63 V
最小供电电压：	2.38 V	标称供电电压：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	TIN LEAD
端子形式：	BALL	端子节距：	1.27 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	30
宽度：	27 mm	uPs/uCs/外围集成电路类型：	MICROPROCESSOR, RISC
Base Number Matches：	1

L9A0212 数据手册

TinyRISC LR4102

Microprocessor

Datasheet

The TinyRISC LR4102 Microprocessor is a compact, high performance

32-bit microprocessor implemented in the LSI Logic G11™ technology.

The LR4102 is a complete microprocessor solution with caches, an

external bus interface with built-in memory controllers, and on-chip

debug. The LR4102 is built using the EZ4102 EasyMACRO subsystem,

available to customers through the LSI Logic CoreWare program.

The LR4102 provides a 32-bit FBusMACRO to control all off-chip data

transactions (including DRAM or SDRAM) and an EJTAG interface for

on-chip debug with PC trace output. Figure 1 illustrates the LR4102 chip.

Figure 1

LR4102 Block Diagram

LR4102

MMU

TLB RAM

Caches

OCM

BIU and Cache

Controller (BBCC)

32-bit TinyRISC

4102 CPU

and FastMDU

Clock

Controller

FBus

FBus-

MACRO

Two 32-bit Timers

SerialICE™-1 Port

EJTAG

SerialICE-1

Interface

EJTAG

Interface

EJTAG

Extended Debug MACRO

PC Trace

Output

The LR4102 microprocessor is powered by either 2.5 V (for 85 MHz

operation) or 1.8 V (for 50 MHz operation). The chip I/O ring requires

3.3 V. With a system clock of 85 MHz, peak performance is 85 MIPS and

sustained performance is estimated at 68 MIPS. With a 50 MHz clock,

performance is 50 MIPS peak and 40 MIPS sustained.

March 2000

12 3 4 5 6 7...32

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