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IDT71V67802

更新时间： 2022-12-14 16:29:22
品牌 Logo 应用领域
艾迪悌 - IDT 计数器静态存储器
页数 文件大小 规格书
23页 515K
描述
256K X 36, 512K X 18 3.3V Synchronous SRAMs 2.5V I/O, Burst Counter Pipelined Outputs, Single Cycle Deselect

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IDT71V67802 数据手册

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IDT71V67602, IDT71V67802, 256K x 36, 512K x 18, 3.3V Synchronous  
SRAMs with 2.5V I/O, Pipelined Outputs, Single Cycle Deselect  
Commercial and Industrial Temperature Ranges  
Pin Configuration – 256K x 36, 119 BGA  
1
2
3
4
5
6
7
DDQ  
6
4
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DDQ  
V
V
A
A
A
A
A
A
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A
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A17  
NC  
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P3  
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G
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2
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DDQ  
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DD  
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V
V
NC  
NC  
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24  
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SS  
4
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I/O  
I/O  
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CLK  
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V
I/O  
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K
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I/O  
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I/O  
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SS  
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A
(1)  
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A
A
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VDD / NC  
LBO  
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A
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A
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DNU  
ZZ  
,
(3)  
(3)  
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(3)  
(3)  
DDQ  
V
DDQ  
V
DNU  
DNU  
U
DNU  
DNU  
5311 drw 04  
Top View  
Pin Configuration – 512K x 18, 119 BGA  
1
2
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4
5
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DDQ  
6
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DDQ  
V
A
B
C
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F
V
A
A
A
A
A
A
A
ADSP  
ADSC  
(4)  
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NC  
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NC  
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SS  
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NC  
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CE  
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NC  
I/O  
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G
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V
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DDQ  
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DD  
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SS  
SS  
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K
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I/O  
I/O  
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CLK  
NC  
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SS  
1
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NC  
1
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14  
SS  
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V
DDQ  
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M
N
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V
I/O  
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I/O  
V
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BWE  
15  
SS  
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1
SS  
0
I/O  
I/O  
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A
A
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I/O  
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NC  
(1)  
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DD  
V
12  
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NC  
NC  
DDQ  
A
V
DD / NC  
A
NC  
LBO  
(2)  
,
10  
15  
14  
A
A
A
NC  
A
ZZ  
(3)  
(3)  
(3)  
(3)  
(3)  
DDQ  
V
5311 drw 05  
DNU  
DNU  
U
V
DNU  
DNU  
DNU  
Top View  
NOTES:  
1. R5 can either be directly connected to VDD, or connected to an input voltage ≥ VIH, or left unconnected.  
2. T7 can be left unconnected and the device will always remain in active mode.  
3. Pin U6 will be internally pulled to VDD if not actively driven. To disable the TAP controller without interfering with normal operation, TRST should be tied low  
and TCK, TDI, and TMS should be pulled through a resistor to 3.3V. TDO should be left unconnected.  
4. On future 18M device CS0 will be removed, B2 will be be used for address expansion.  
6.42  
7
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IDT71V67802133BG IDT 256K X 36, 512K X 18 3.3V Synchronous SRAMs 2.5V I/O, Burst Counter Pipelined Outputs, Sin

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