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ICS8725AYI-01LFT

更新时间： 2024-11-16 15:34:39

品牌	Logo	应用领域
艾迪悌 - IDT		驱动逻辑集成电路
页数	文件大小	规格书
16页	515K
描述
PLL Based Clock Driver, 8725 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32

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ICS8725AYI-01LFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LQFP,	针数：	32
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.36	系列：	8725
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-PQFP-G32
JESD-609代码：	e3	长度：	7 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	32
实输出次数：	5	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	LQFP	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	4.5 ns	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.05 ns	座面最大高度：	1.6 mm
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	7 mm	最小 fmax：	31.25 MHz
Base Number Matches：	1

ICS8725AYI-01LFT 数据手册

ICS8725I-01

1:5 DIFFERENTIAL-TO-HSTL

ZERO DELAY CLOCK GENERATOR

GENERAL DESCRIPTION

FEATURES

The ICS8725I-01 is a highly versatile 1:5 Differ-

• 5 differential HSTL outputs

ICS

ential-to-HSTL Clock Generator and a member

of the HiPerClockS™family of High Performance

Clock Solutions from ICS.The ICS8725I-01 has

a fully integrated PLL and can be configured as

• Selectable differential CLKx, nCLKx input pairs

HiPerClockS™

• CLKx, nCLKx pairs can accept the following differential

input levels: LVDS, LVPECL, HSTL, SSTL, HCSL

zero delay buffer, multiplier or divider, and has an output fre-

quency range of 31.25MHz to 630MHz.The reference divider,

feedback divider and output divider are each programmable,

thereby allowing for the following output-to-input frequency

ratios: 8:1, 4:1, 2:1, 1:1, 1:2, 1:4, 1:8. The external feedback

allows the device to achieve “zero delay” between the input

clock and the output clocks. The PLL_SEL pin can be used

to bypass the PLL for system test and debug purposes. In

bypass mode, the reference clock is routed around the PLL

and into the internal output dividers.

• Output frequency range: 31.25MHz to 630MHz

• Input frequency range: 31.25MHz to 630MHz

• VCO range: 250MHz to 630MHz

• External feedback for “zero delay” clock regeneration

with configurable frequencies

• Programmable dividers allow for the following output-to-input

frequency ratios: 8:1, 4:1, 2:1, 1:1, 1:2, 1:4, 1:8

• Static phase offset: 30ps ± 125ps

• Cycle-to-cycle jitter: 35ps (maximum)

• Output skew: 50ps (maximum)

• 3.3V core, 1.8V output operating supply

• -40°C to 85°C ambient operating temperature

• Available in both standard (RoHS5) and lead-free (RoHS 6)

packages

BLOCK DIAGRAM

PIN ASSIGNMENT

PLL_SEL

nQ0

nQ1

÷1, ÷2, ÷4, ÷8,

32 31 30 29 28 27 26 25

CLK0

nCLK0

÷16, ÷32,÷64

nQ2

SEL0

SEL1

V^DDO

CLK1

nCLK1

nQ3

CLK0

nQ3

PLL

nCLK0

CLK1

nQ4

ICS8725I-01

CLK_SEL

nQ2

8:1, 4:1, 2:1, 1:1,

1:2, 1:4, 1:8

nCLK1

CLK_SEL

FB_IN

nFB_IN

nQ1

V^DDO

10 11 12 13 14 15 16

SEL0

SEL1

SEL2

SEL3

32-Lead LQFP

7mm x 7mm x 1.4mm package body

Y Package

TopView

8725AYI-01

REV.A DECEMVER 19, 2007

12 3 4 5 6 7...16

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与ICS8725AYI-01LFT相关器件

型号	品牌	获取价格	描述	数据表
ICS8725AYI-01T	IDT	获取价格	PLL Based Clock Driver, 8725 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7
ICS8725Y	ICSI	获取价格	DIFFERENTIAL-TO-LVHSTL ZERO DELAY BUFFER
ICS8725YT	ICSI	获取价格	DIFFERENTIAL-TO-LVHSTL ZERO DELAY BUFFER
ICS872S480	IDT	获取价格	Differential-to-HSTL Zero Delay Clock Generator
ICS873032AGLF	IDT	获取价格	Low Skew Clock Driver, 873032 Series, 1 True Output(s), 0 Inverted Output(s), PDSO8, 3 X 3
ICS873032AMLF	IDT	获取价格	Low Skew Clock Driver, 873032 Series, 1 True Output(s), 0 Inverted Output(s), PDSO8, 3.90
ICS873032AMLFT	IDT	获取价格	Low Skew Clock Driver, 873032 Series, 1 True Output(s), 0 Inverted Output(s), PDSO8, 3.90
ICS873033	ICSI	获取价格	HIGH SPEED, ÷4 DIFFERENTIAL-TO- 3.3V, 5V LVPE
ICS873033AG	ICSI	获取价格	HIGH SPEED, ÷4 DIFFERENTIAL-TO- 3.3V, 5V LVPE
ICS873033AGLF	ICSI	获取价格	HIGH SPEED, ÷4 DIFFERENTIAL-TO- 3.3V, 5V LVPE

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