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HEF4011BT,653

更新时间: 2024-11-04 20:09:27
品牌 Logo 应用领域
恩智浦 - NXP 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
12页 265K
描述
HEF4011B - Quad 2-input NAND gate SOIC 14-Pin

HEF4011BT,653 技术参数

是否Rohs认证: 符合生命周期:Transferred
零件包装代码:SOIC包装说明:PLASTIC, SO-14
针数:14Reach Compliance Code:compliant
HTS代码:8542.39.00.01风险等级:3.51
系列:4000/14000/40000JESD-30 代码:R-PDSO-G14
长度:8.65 mm负载电容(CL):50 pF
逻辑集成电路类型:NAND GATE最大I(ol):0.00036 A
湿度敏感等级:1功能数量:4
输入次数:2端子数量:14
最高工作温度:85 °C最低工作温度:-40 °C
封装主体材料:PLASTIC/EPOXY封装代码:SOP
封装等效代码:SOP14,.25封装形状:RECTANGULAR
封装形式:SMALL OUTLINE包装方法:TAPE AND REEL
峰值回流温度(摄氏度):260电源:5/15 V
Prop。Delay @ Nom-Sup:110 ns传播延迟(tpd):110 ns
认证状态:Not Qualified施密特触发器:NO
座面最大高度:1.75 mm子类别:Gates
最大供电电压 (Vsup):15 V最小供电电压 (Vsup):3 V
标称供电电压 (Vsup):5 V表面贴装:YES
技术:CMOS温度等级:INDUSTRIAL
端子面层:NICKEL/PALLADIUM/GOLD (NI/PD/AU)端子形式:GULL WING
端子节距:1.27 mm端子位置:DUAL
处于峰值回流温度下的最长时间:30宽度:3.9 mm
Base Number Matches:1

HEF4011BT,653 数据手册

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HEF4011B  
Quad 2-input NAND gate  
Rev. 5 — 21 November 2011  
Product data sheet  
1. General description  
The HEF4011B is a quad 2-input NAND gate. The outputs are fully buffered for the  
highest noise immunity and pattern insensitivity to output impedance.  
It operates over a recommended VDD power supply range of 3 V to 15 V referenced to VSS  
(usually ground). Unused inputs must be connected to VDD, VSS, or another input.  
2. Features and benefits  
Fully static operation  
5 V, 10 V, and 15 V parametric ratings  
Standardized symmetrical output characteristics  
Specified from 40 C to +125 C  
Complies with JEDEC standard JESD 13-B  
Inputs and outputs are protected against electrostatic effects  
3. Ordering information  
Table 1.  
Ordering information  
All types operate from 40 C to +125 C  
Type number Package  
Name  
DIP14  
SO14  
Description  
Version  
HEF4011BP  
HEF4011BT  
plastic dual in-line package; 14 leads (300 mil)  
plastic small outline package; 14 leads; body width 3.9 mm  
SOT27-1  
SOT108-1  
4. Functional diagram  
1A  
1B  
1
2
3
4
1Y  
2Y  
2A  
2B  
5
6
3A  
3B  
8
9
10 3Y  
11 4Y  
4A  
4B  
12  
13  
nA  
nB  
nY  
001aan874  
001aan875  
Fig 1. Functional diagram  
Fig 2. Logic diagram (one gate)  
 
 
 
 

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