GTLP6C817MTC

更新时间： 2024-11-20 22:20:15

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飞兆/仙童 - FAIRCHILD		时钟驱动器逻辑集成电路光电二极管
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7页	54K
描述
Low Drive GTLP-to-LVTTL 1:6 Clock Driver

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GTLP6C817MTC 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	4.40 MM, MO-153, TSSOP-24
针数：	24	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.78
Is Samacsys：	N	系列：	GTLP
输入调节：	STANDARD	JESD-30 代码：	R-PDSO-G24
JESD-609代码：	e3	长度：	7.8 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	湿度敏感等级：	1
功能数量：	1	反相输出次数：
端子数量：	24	实输出次数：	8
最高工作温度：	85 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP24,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	3.3,5 V
传播延迟（tpd）：	4.6 ns	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.5 ns	座面最大高度：	1.2 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	5.25 V
最小供电电压 (Vsup)：	4.75 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	4.4 mm
Base Number Matches：	1

GTLP6C817MTC 数据手册

June 1999

Revised August 1999

GTLP6C817

Low Drive GTLP-to-LVTTL 1:6 Clock Driver

General Description

Features

The GTLP6C817 is a low drive clock driver that provides

TTL to GTLP signal level translation (and vice versa). The

device provides a high speed interface between cards

operating at TTL logic levels and a backplane operating at

GTLP logic levels. High speed backplane operation is a

direct result of GTLP’s reduced output swing (<1V),

reduced input threshold levels and output edge rate con-

trol. The edge rate control minimizes bus settling time.

GTLP is a Fairchild Semiconductor derivative of the Gun-

ning Transceiver logic (GTL) JEDEC standard JESD8-3.

■ Interface between TTL and GTLP logic levels

■ Edge Rate Control to minimize noise on the GTLP port

■ Power up/down high impedance for live insertion

■ 1:6 fanout clock driver for LVTTL port

■ 1:2 fanout clock driver for GTLP port

■ LVTTL compatible driver and control inputs

■ 5V over voltage tolerance on LVTTL ports

■ Flow through pinout optimizes PCB layout

■ Open drain on GTLP to support wired-or connection

■ Recommended Operating Temperature −40°C to +85°C

Fairchild’s GTLP has internal edge-rate control and is pro-

cess, voltage, and temperature (PVT) compensated. Its

function is similar to BTL and GTL but with different output

levels and receiver threshold. GTLP output LOW level is

typically less than 0.5V, the output level HIGH is 1.5V and

the receiver threshold is 1.0V.

Ordering Code:

Order Number

Package Number Package Description

GTLP6C817MTC

MTC24

24-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide

Pin Descriptions

Connection Diagram

Pin Names

Description

TTLIN, GTLPIN Clock Inputs (TTL and GTLP respectively)

OEB

Output Enable (Active LOW)

GTLP Port (TTL Levels)

OEA

Output Enable (Active LOW)

TTL Port (TTL Levels)

V_CCT.GNDT

V_CC

LVTTL Output Supplies (3V)

Internal Circuitry V_CC(5V)

OBn GTLP Output Grounds

Voltage Reference Input

GNDG

V_REF

OA0–OA5

OB0–OB1

TTL Buffered Clock Outputs

GTLP Buffered Clock Outputs

DS500246

www.fairchildsemi.com

12 3 4 5 6 7

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型号	品牌	获取价格	描述	数据表
GTLP6C817MTCX	ETC	获取价格	Eight Distributed-Output Clock Driver
GTLP8T306	FAIRCHILD	获取价格	8-Bit LVTTL/GTLP Bus Transceiver
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