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| 生命周期： | Obsolete | 包装说明： | DIP, |
| Reach Compliance Code： | unknown | HTS代码： | 8542.39.00.01 |
| 风险等级： | 5.66 | 其他特性： | POWER-UP RESET; REGISTER PRELOAD |
| 最大时钟频率： | 45.5 MHz | JESD-30 代码： | R-PDIP-T24 |
| 长度： | 31.915 mm | 专用输入次数： | 12 |
| I/O 线路数量： | 8 | 端子数量： | 24 |
| 最高工作温度： | 75 °C | 最低工作温度： | |
| 组织： | 12 DEDICATED INPUTS, 8 I/O | 输出函数： | MACROCELL |
| 封装主体材料： | PLASTIC/EPOXY | 封装代码： | DIP |
| 封装形状： | RECTANGULAR | 封装形式： | IN-LINE |
| 可编程逻辑类型： | EE PLD | 传播延迟： | 12 ns |
| 认证状态： | Not Qualified | 座面最大高度： | 5.08 mm |
| 最大供电电压： | 5.25 V | 最小供电电压： | 4.75 V |
| 标称供电电压： | 5 V | 表面贴装： | NO |
| 技术： | CMOS | 温度等级： | COMMERCIAL EXTENDED |
| 端子形式： | THROUGH-HOLE | 端子节距： | 2.54 mm |
| 端子位置： | DUAL | 宽度： | 7.62 mm |
| Base Number Matches： | 1 |
| 型号 | 品牌 | 获取价格 | 描述 | 数据表 |
| GAL20V8A-12VC | ETC |
获取价格 |
Electrically-Erasable PLD |
|
| GAL20V8A-15 | NSC |
获取价格 |
Generic Array Logic |
|
| GAL20V8A-15JC | TI |
获取价格 |
EE PLD, 15ns, CDIP24, CERAMIC, DIP-24 |
|
| GAL20V8A-15JM | ETC |
获取价格 |
Electrically-Erasable PLD |
|
| GAL20V8A-15L | NSC |
获取价格 |
Generic Array Logic |
|
| GAL20V8A15LD | ETC |
获取价格 |
ASIC |
|
| GAL20V8A-15LD/883 | LATTICE |
获取价格 |
EE PLD, 15ns, PAL-Type, CMOS, CDIP24, 0.300 INCH, CERDIP-24 |
|
| GAL20V8A-15LD/883C | LATTICE |
获取价格 |
EE PLD, 15ns, CMOS, CDIP24, CERDIP-24 |
|
| GAL20V8A15LDI | ETC |
获取价格 |
ASIC |
|
| GAL20V8A-15LDM | ETC |
获取价格 |
Electrically-Erasable PLD |
|
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