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FPD85310

更新时间： 2023-12-18 00:00:00
品牌 Logo 应用领域
美国国家半导体 - NSC 控制器
页数 文件大小 规格书
29页 443K
描述
Panel Timing Controller

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FPD85310 技术参数

生命周期：Obsolete零件包装代码：QFP
包装说明：TFQFP,针数：100
Reach Compliance Code：unknownHTS代码：8542.31.00.01
风险等级：5.84JESD-30 代码：S-PQFP-G100
长度：14 mm端子数量：100
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：TFQFP
封装形状：SQUARE封装形式：FLATPACK, THIN PROFILE, FINE PITCH
认证状态：Not Qualified座面最大高度：1.2 mm
最大供电电压：3.6 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD宽度：14 mm
uPs/uCs/外围集成电路类型：MICROPROCESSOR CIRCUITBase Number Matches：1

FPD85310 数据手册

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September 1999  
FPD85310  
Panel Timing Controller  
General Description  
Features  
n FPD-Link System Interface utilizes Low Voltage  
Differential Signaling (LVDS).  
The FPD85310 Panel Timing Controller is an integrated  
FPD-Link based TFT-LCD timing controller. It resides on the  
flat panel display and provides the interface signal routing  
and timing control between graphics or video controllers and  
a TFT-LCD system. FPD-Link is a low power, low electro-  
magnetic interference interface used between this controller  
and the host system.  
n System programmable via EEPROM  
n Suitable for notebook and monitor applications  
n 8-bit or 6-bit system interface  
n XGA or SVGA capable  
n Supports single or dual port column drivers  
n Programmable outputs provide customized control for  
standard or in-house column drivers and row drivers  
n Fail-safe operation prevents panel damage with system  
clock failure  
The FPD85310 chip links the panel’s system interface to the  
display via a ten wire LVDS data bus. That data is then  
routed to the source and gate display drivers. XGA and  
SVGA resolutions are supported.  
The FPD85310 is programmable via an optional external se-  
rial EEPROM. Reserved space in the EEPROM is available  
for display identification information. The system can access  
the EEPROM to read the display identification data or pro-  
gram initialization values used by the FPD85310.  
n Programmable skew rate controlled outputs on CD  
interface for reduced EMI  
n Polarity pin reduces CD data bus switching  
n CMOS circuitry operates from a 3.3V supply  
System Diagram  
DS101086-1  
TRI-STATE® is a registered trademark of National Semiconductor Corporation.  
© 1999 National Semiconductor Corporation  
DS101086  
www.national.com  
1234567...29

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型号 品牌 获取价格 描述 数据表
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