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FM25W256-GTR

更新时间： 2024-01-22 08:39:57
品牌 Logo 应用领域
铁电 - RAMTRON 存储内存集成电路静态存储器光电二极管
页数 文件大小 规格书
13页 293K
描述
256Kb Wide Voltage SPI F-RAM

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FM25W256-GTR 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：SOP, SOP8,.25Reach Compliance Code：unknown
风险等级：5.88Is Samacsys：N
JESD-30 代码：R-PDSO-G8JESD-609代码：e0
内存密度：262144 bit内存集成电路类型：NON-VOLATILE SRAM
内存宽度：8端子数量：8
字数：32768 words字数代码：32000
最高工作温度：85 °C最低工作温度：-40 °C
组织：32KX8封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP8,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
电源：3/5 V认证状态：Not Qualified
最大待机电流：0.00015 A子类别：SRAMs
最大压摆率：0.007 mA表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
Base Number Matches：1

FM25W256-GTR 数据手册

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FM25W256 - 256Kb SPI F-RAM  
WP  
CS  
Instruction Decode  
Clock Generator  
Control Logic  
HOLD  
SCK  
Write Protect  
4K x 64  
FRAM Array  
Instruction Register  
15  
8
Address Register  
Counter  
SI  
SO  
Data I/O Register  
3
Nonvolatile Status  
Register  
Figure 1. Block Diagram  
Pin Descriptions  
Pin Name  
I/O  
Description  
/CS  
Input  
Chip Select: This active low input activates the device. When high, the device enters  
low-power standby mode, ignores other inputs, and all outputs are tri-stated. When  
low, the device internally activates the SCK signal. A falling edge on /CS must occur  
prior to every op-code.  
SCK  
Input  
Input  
Serial Clock: All I/O activity is synchronized to the serial clock. Inputs are latched on  
the rising edge and outputs occur on the falling edge. Since the device is static, the  
clock frequency may be any value between 0 and 20 MHz and may be interrupted at  
any time.  
Hold: The /HOLD pin is used when the host CPU must interrupt a memory operation  
for another task. When /HOLD is low, the current operation is suspended. The device  
ignores any transition on SCK or /CS. All transitions on /HOLD must occur while  
SCK is low.  
/HOLD  
/WP  
SI  
Input  
Input  
Write Protect: This active low pin prevents write operations to the status register only.  
A complete explanation of write protection is provided on pages 6 and 7.  
Serial Input: All data is input to the device on this pin. The pin is sampled on the  
rising edge of SCK and is ignored at other times. It should always be driven to a valid  
logic level to meet IDD specifications.  
* SI may be connected to SO for a single pin data interface.  
Serial Output: This is the data output pin. It is driven during a read and remains tri-  
stated at all other times including when /HOLD is low. Data transitions are driven on  
the falling edge of the serial clock.  
SO  
Output  
* SO may be connected to SI for a single pin data interface.  
Power Supply: 2.7V to 5.5V  
Ground  
VDD  
VSS  
Supply  
Supply  
Rev. 1.3  
Feb. 2011  
Page 2 of 13  
1234567...13

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与FM25W256-GTR相关器件

型号 品牌 描述 获取价格 数据表
FM25W256-S ETC 256Kb FRAM Wide Voltage Serial Memory

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FM25W32 FM SPI NOR Flash

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