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DS1073M-80

更新时间： 2024-01-10 15:28:51

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达拉斯 - DALLAS		/
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18页	261K
描述
3V EconOscillator/Divider

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DS1073M-80 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Active	零件包装代码：	DIP
包装说明：	DIP,	针数：	8
Reach Compliance Code：	unknown	风险等级：	5.68
JESD-30 代码：	R-PDIP-T8	JESD-609代码：	e0
长度：	9.375 mm	湿度敏感等级：	NOT SPECIFIED
端子数量：	8	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	245
认证状态：	COMMERCIAL	座面最大高度：	4.572 mm
最大供电电压：	3.6 V	最小供电电压：	2.7 V
标称供电电压：	3 V	表面贴装：	NO
温度等级：	COMMERCIAL	端子面层：	TIN LEAD
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	7.62 mm	uPs/uCs/外围集成电路类型：	MICROPROCESSOR CIRCUIT
Base Number Matches：	1

DS1073M-80 数据手册

DS1073

AC ELECTRICAL CHARACTERISTICS

(T_A= -40°C to +85°C) (V_CC= 2.7V – 3.6V)

PARAMETER

Output Frequency

Accuracy

SYMBOL CONDITION MIN TYP MAX UNITS NOTES

V_CC= 3.15V,

f_O

-0.5

+0.5

T_A= 25LC

Over temp and

voltage

Combined Frequency

Variation

-2.5%

-0.5

2.5%

ꢃf_O’

ꢃf_O”

Long Term Stability

+0.5

MHz

External clock

Crystal

Maximum Input

Frequency

f_OSCIN

MHz

kHz

reference

Minimum Output

Frequency

f_OUT

t_POR

29.3

Power-Up Time

0.1

4, 5

t_STAB

t_PDN

0.1

5, 6

Enable OUT from PDN ↑

Enable OUT0 from PDN ↑

I/O Hi-Z from PDN ↓

t_PDN

OUT0 Hi-Z from PDN ↓

Load Capacitance

(I/O, OUT0)

Output Duty Cycle

I/O

C_L

OUT0

Jitter

100

NOTES:

1. Additive to ꢃf_O’.

2. This is the maximum frequency which can be applied to OSCIN, or the maximum crystal frequency

that can be used. If a crystal is used, it must be operated in fundamental mode.

3. The values of M, N and the frequency of OSCIN (if used) must be chosen so that this spec is met.

4. This is the time from when V_CCis applied until the output starts oscillating.

5. When the device is initially powered up or restored from the power-down mode, OE should be

asserted (high). Otherwise the start of the t_stabinterval will be delayed until OE goes high. OE can

subsequently be returned to a low level during the t_stabinterval to force out low after the t_stabinterval.

If the external mode is selected, t_stabwill be a function of the OSCIN period, i.e., external clock

frequency. See “Calculated Parameters” to determine the value of t_stabin this case.

6. Although OE does not normally affect OUT0 operation, if OE is held low during power-up, the start

of the t_stabperiod will be delayed until OE is asserted. If OE remains low, OUT0 will not start.

7. Operation with higher capacitive loads is possible but may impair output voltage swing and maximum

operation frequency.

8. Parameter given is a typical max.

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1...15 16 1718

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