DM54194J-MIL

更新时间： 2024-10-26 13:02:03

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美国国家半导体 - NSC		移位寄存器
页数	文件大小	规格书
6页	124K
描述
IC,SHIFT REGISTER,STD-TTL,DIP,16PIN,CERAMIC

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DM54194J-MIL 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	DIP, DIP16,.3	Reach Compliance Code：	compliant
风险等级：	5.86	计数方向：	BIDIRECTIONAL
JESD-30 代码：	R-XDIP-T16	JESD-609代码：	e0
最大频率@ Nom-Sup：	25000000 Hz	位数：	4
功能数量：	1	端子数量：	16
最高工作温度：	125 °C	最低工作温度：	-55 °C
封装主体材料：	CERAMIC	封装代码：	DIP
封装等效代码：	DIP16,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	电源：	5 V
认证状态：	Not Qualified	筛选级别：	MIL-STD-883 Class B (Modified)
子类别：	Shift Registers	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	技术：	TTL
温度等级：	MILITARY	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	Base Number Matches：	1

DM54194J-MIL 数据手册

June 1989

DM54194

4-Bit Bidirectional Universal Shift Registers

General Description

This bidirectional shift register is designed to incorporate

virtually all of the features a system designer may want in a

shift register; it features parallel inputs, parallel outputs,

right-shift and left-shift serial inputs, operating-mode-control

inputs, and a direct overriding clear line. The register has

four distinct modes of operation, namely:

Clocking of the flip-flop is inhibited when both mode control

inputs are low. The mode controls of the DM54194/

DM74194 should be changed only while the clock input is

high.

Features

Parallel (broadside) load

Shift right (in the direction Q toward Q )

Parallel inputs and outputs

Shift left (in the direction Q toward Q )

Four operating modes:

Synchronous parallel load

Right shift

Left shift

Inhibit clock (do nothing)

Synchronous parallel loading is accomplished by applying

the four bits of data and taking both mode control inputs, S0

and S1, high. The data is loaded into the associated flip-

flops and appears at the outputs after the positive transition

of the clock input. During loading, serial data flow is inhibit-

ed.

Do nothing

Positive edge-triggered clocking

Direct overriding clear

Typical clock frequency 36 MHz

Typical power dissipation 195 mW

Shift right is accomplished synchronously with the rising

edge of the clock pulse when S0 is high and S1 is low.

Serial data for this mode is entered at the shift-right data

input. When S0 is low and S1 is high, data shifts left syn-

chronously and new data is entered at the shift-left serial

input.

Connection Diagram

Dual-In-Line Package

TL/F/6564–1

Order Number DM54194J or DM54194W

See NS Package Number J16A or W16A

1995 National Semiconductor Corporation

TL/F/6564

RRD-B30M105/Printed in U. S. A.

12 3 4 5 6

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与DM54194J-MIL相关器件

型号	品牌	获取价格	描述	数据表
DM54194W	NSC	获取价格	4-Bit Bidirectional Universal Shift Registers
DM54194W/883	ROCHESTER	获取价格	Parallel In Parallel Out, TTL/H/L Series, 4-Bit, Bidirectional, True Output, TTL, CDFP16,
DM54194W/883	TI	获取价格	TTL/H/L SERIES, 4-BIT BIDIRECTIONAL PARALLEL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT,
DM54194W/883B	TI	获取价格	IC,SHIFT REGISTER,STD-TTL,FP,16PIN,CERAMIC
DM54194W/883C	TI	获取价格	IC,SHIFT REGISTER,STD-TTL,FP,16PIN,CERAMIC
DM54196J	NSC	获取价格	IC,COUNTER,UP,DECADE,STD-TTL,DIP,14PIN,CERAMIC
DM54196J	TI	获取价格	IC,COUNTER,UP,DECADE,STD-TTL,DIP,14PIN,CERAMIC
DM54196J/883	TI	获取价格	IC,COUNTER,UP,DECADE,STD-TTL,DIP,14PIN,CERAMIC
DM54196J/883B	TI	获取价格	IC,COUNTER,UP,DECADE,STD-TTL,DIP,14PIN,CERAMIC
DM54196J/883C	TI	获取价格	IC,COUNTER,UP,DECADE,STD-TTL,DIP,14PIN,CERAMIC

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