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CY7C09369V-12AI PDF预览

CY7C09369V-12AI

更新时间： 2024-02-19 01:33:30
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟静态存储器内存集成电路
页数 文件大小 规格书
16页 526K
描述
Dual-Port SRAM, 16KX18, 12ns, CMOS, PQFP100, PLASTIC, TQFP-100

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CY7C09369V-12AI 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：PLASTIC, TQFP-100
针数：100Reach Compliance Code：not_compliant
ECCN代码：3A991.B.2.BHTS代码：8542.32.00.41
风险等级：5.52最长访问时间：12 ns
最大时钟频率 (fCLK)：50 MHzI/O 类型：COMMON
JESD-30 代码：S-PQFP-G100JESD-609代码：e0
内存密度：294912 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：18功能数量：1
端口数量：2端子数量：100
字数：16384 words字数代码：16000
工作模式：SYNCHRONOUS最高工作温度：85 °C
最低工作温度：-40 °C组织：16KX18
输出特性：3-STATE可输出：YES
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装等效代码：QFP100,.63SQ,20封装形状：SQUARE
封装形式：FLATPACK并行/串行：PARALLEL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：3.3 V
认证状态：Not Qualified最大待机电流：0.0001 A
最小待机电流：3 V子类别：SRAMs
最大压摆率：0.25 mA最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
Base Number Matches：1

CY7C09369V-12AI 数据手册

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CY7C09269V/79V/89V  
CY7C09369V/79V/89V  
PRELIMINARY  
Switching Characteristics Over the Operating Range  
CY7C09269V/79V/89V  
CY7C09369V/79V/89V  
[1]  
-7  
-9  
-12  
Symbol  
Parameter  
Flow-Through  
Min  
Max  
45  
Min  
Max  
40  
Min  
Max  
33  
Units  
MHz  
MHz  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
f
f
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
t
f
f
MAX1  
MAX2  
CYC1  
CYC2  
CH1  
CL1  
CH2  
CL2  
R
Max  
Max  
Pipelined  
83  
67  
50  
Clock Cycle Time - Flow-Through  
Clock Cycle Time - Pipelined  
Clock HIGH Time - Flow-Through  
Clock LOW Time - Flow-Through  
Clock HIGH Time - Pipelined  
Clock LOW Time - Pipelined  
Clock Rise Time  
22  
12  
7.5  
7.5  
5
25  
15  
12  
12  
6
30  
20  
12  
12  
8
5
6
8
3
3
3
3
3
3
Clock Fall Time  
F
Address Set-Up Time  
4
0
4
1
4
1
4
1
4
1
4
1
5
1
4
1
4
1
4
1
4
1
4
1
4
1
5
1
4
1
SA  
Address Hold Time  
HA  
Chip Enable Set-Up Time  
Chip Enable Hold Time  
R/W Set-Up Time  
4
SC  
0
HC  
4
SW  
R/W Hold Time  
0
HW  
Input Data Set-Up Time  
Input Data Hold Time  
4
SD  
0
HD  
ADS Set-Up Time  
4
SAD  
HAD  
SCN  
HCN  
SRST  
HRST  
ADS Hold Time  
0
CNTEN Set-Up Time  
4.5  
0
CNTEN Hold Time  
CNTRST Set-Up Time  
CNTRST Hold Time  
4
0
Output Enable to Data Valid  
OE to Low Z  
9
10  
12  
OE  
[12,13]  
2
1
2
1
2
1
OLZ  
[12,13]  
OHZ  
OE to High Z  
7
7
20  
9
7
Clock to Data Valid - Flow-Through  
Clock to Data Valid - Pipelined  
Data Output Hold After Clock HIGH  
Clock HIGH to Output High Z  
Clock HIGH to Output Low Z  
18  
7.5  
25  
12  
CD1  
CD2  
DC  
2
2
2
2
2
2
2
2
2
[12,13]  
9
9
9
CKZ  
[12,13]  
CKZ  
Port to Port Delays  
t
t
Write Port Clock HIGH to Read Data Delay  
Clock to Clock Set-Up Time  
35  
10  
40  
15  
40  
15  
ns  
ns  
CWDD  
CCS  
Shaded area contains advance information.  
Notes:  
12. Test conditions used are Load 2.  
13. This parameter is guaranteed by design, but it is not production tested.  
6
1...3456789...16

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型号 品牌 获取价格 描述 数据表
CY7C09369V-12AXC CYPRESS

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 		3.3V 16K/32K/64K x 16/18 Synchronous Dual-Port Static RAM
CY7C09369V-6AC CYPRESS

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 		3.3V 16K/32K/64K x 16/18 Synchronous Dual-Port Static RAM
CY7C09369V-6ACT CYPRESS

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 		暂无描述
CY7C09369V-6AXC CYPRESS

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 		3.3V 16K/32K/64K x 16/18 Synchronous Dual-Port Static RAM
CY7C09369V-6AXC ROCHESTER

获取价格

 		16KX18 DUAL-PORT SRAM, 6.5ns, PQFP100, LEAD FREE, PLASTIC, MS-026, TQFP-100
CY7C09369V-7AC CYPRESS

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 		3.3V 16K/32K/64K x 16/18 Synchronous Dual-Port Static RAM
CY7C09369V-7AI CYPRESS

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 		3.3V 16K/32K/64K x 16/18 Synchronous Dual-Port Static RAM
CY7C09369V-7AXC ROCHESTER

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 		16KX18 DUAL-PORT SRAM, 7.5ns, PQFP100, LEAD FREE, PLASTIC, MS-026, TQFP-100
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