CY23020LFI-3T

更新时间： 2024-01-22 16:22:49

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赛普拉斯 - CYPRESS		时钟驱动器逻辑集成电路
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9页	112K
描述
10-output, 400-MHz LVPECL Zero Delay Buffer

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CY23020LFI-3T 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	QFN
包装说明：	7 X 7 MM, QFN-48	针数：	48
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.85	系列：	23020
输入调节：	DIFFERENTIAL	JESD-30 代码：	S-XQCC-N48
JESD-609代码：	e0	长度：	7 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	48
实输出次数：	9	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装等效代码：	LCC48,.27SQ,20	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	240
电源：	3.3 V	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.15 ns	座面最大高度：	1 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	TIN LEAD	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	7 mm
最小 fmax：	400 MHz	Base Number Matches：	1

CY23020LFI-3T 数据手册

CY23020-3

All board transmission lines 50

and 0.57ns propagation delay.

Ω

0.57ns

FBIN+ OUT

REFIN- OUT

REFIN+ OUT

FBIN-+

REF-

FBIN+ OUT

PULSE

GEN

100

FBIN+

REF+

C Selected to produce

1-2.5V/ns at pin

FBOUT+

FBOUT-

Q5+

100

C^L

100

Q5-

Q1+

Q1-

Q4+

100

C^L

100

Q4-

Figure 4. Test Set-up 3 Example^[10]

Package Type

Ordering Information

Ordering Code

Temperature Range

CY23020LFI-3

48-pin QFN

48-pin QFN–Tape and Reel

Industrial, –40°C to +85°C

CY23020LFI-3T

Note:

10. If accurate pin-pin skew is not obtainable with the load capacitors, a third configuration can be made with no load C. In this case only pin-pin skew is

characterized. Part must be in PLL bypass mode.

Document #: 38-07473 Rev. *A

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