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CDCDB2000

更新时间： 2024-10-01 11:14:31

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德州仪器 - TI		时钟 PC
页数	文件大小	规格书
39页	1504K
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符合 DB2000QL 标准、适用于第 1 代到第 5 代 PCIe® 的 20 路输出时钟缓冲器

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CDCDB2000

ZHCSKG8A –NOVEMBER 2019–REVISED FEBRUARY 2020

符合 CDCDB2000 DB2000QL 标准的 20 输出时钟缓冲器，适用于 PCIe

第 1 代到第 5 代

1 特性

2 应用

•

具有集成 85Ω 输出终端的 20 LP-HCSL 输出

•

微服务器和塔式服务器

8 硬件输出使能端 (OE#) 控制装置

使用 DB2000QL 滤波器之后的附加相位抖动：

< 0.08ps rms

存储区域网络和主机总线适配器卡

网络附加存储

硬件加速器

•

支持 PCIe 第 4 代和第 5 代常见时钟 (CC) 频率和

单独基准 (IR) 架构

3 说明

–

与扩频兼容

CDCDB2000 是一款符合 DB2000QL 标准的 20 输出

LP-HCSL 时钟缓冲器，能够为 PCIe 第 1 代到第 5

代、QuickPath Interconnect (QPI)、UPI、SAS 和

SATA 接口分配参考时钟。使用 SMBus、SBI 和 8 输

出使能引脚，可以单独配置和控制所有 20 个输出。

CDCDB2000 是一个 DB2000QL 衍生缓冲器，达到或

超过 DB2000QL 规格中的系统参数。CDCDB2000 采

用具有 80 个引线的 6mm × 6mm TLGA/GQFN 封

装。

•

周期到周期抖动：< 50ps

输出到输出偏斜：< 50ps

输入到输出延迟：< 3ns

3.3V 内核和 IO 电源电压

硬件控制的低功耗模式 (PD#)

用于在 PD# 模式下进行输出控制的边带接口 (SBI)

9 个可选 SMBus 地址

功耗：< 600mW

6mm × 6mm，80 引脚 TLGA/GQFN 封装

器件信息⁽¹⁾

器件型号

封装

TLGA (80)

封装尺寸（标称值）

CDCDB2000

6.00mm × 6.00mm

(1) 如需了解所有可用封装，请参阅数据表末尾的可订购产品附

录。

CDCDB2000 系统图

PCIe PHY

PCIe Device

PCIe Gen 4-5

Clock

Generator

LP-HCSL

CDCDB2000

20x LP-HSCL Output Buffer

LP-HCSL

OE#

Control

SMBus

Control

Side-Band

Interface

Control Interface

本文档旨在为方便起见，提供有关 TI 产品中文版本的信息，以确认产品的概要。有关适用的官方英文版本的最新信息，请访问 www.ti.com，其内容始终优先。 TI 不保证翻译的准确

性和有效性。在实际设计之前，请务必参考最新版本的英文版本。

English Data Sheet: SNAS787

12 3 4 5 6 7...39

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型号	品牌	获取价格	描述	数据表
CDCDB2000NPPR	TI	获取价格	符合 DB2000QL 标准、适用于第 1 代到第 5 代 PCIe® 的 20
CDCDB2000NPPT	TI	获取价格	符合 DB2000QL 标准、适用于第 1 代到第 5 代 PCIe® 的 20
CDCDB400	TI	获取价格	适用于 PCIe® 第 1 代到第 5 代的 4 路输出时钟缓冲器
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CDCDB803RSLR	TI	获取价格	用于 PCIe® 第 1 代至第 5 代的 8 输出时钟缓冲器，具有可选的 SMBus 地

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