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CDCDB800RSLR

更新时间： 2023-09-03 20:33:51

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德州仪器 - TI		时钟 PC
页数	文件大小	规格书
34页	1627K
描述
适用于 PCIe® 第 1 代到第 5 代 8 路输出时钟缓冲器 \| RSL \| 48 \| -40 to 105

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CDCDB800RSLR 数据手册

CDCDB800

ZHCSM95B –JULY 2021 –REVISED MAY 2022

CDCDB800 适用于第1 代到第6 代PCIe、符合DB800ZL 标准的8 输出时钟缓冲

器

1 特性

2 应用

• 微服务器和塔式服务器

• 存储区域网络和主机总线适配器卡

• 网络连接存储

• 硬件加速器

• 机架式服务器

• 具有可编程集成85Ω（默认值）或100Ω 差分输出

终端的8 个LP-HCSL 输出

• 8 硬件输出使能端(OE#) 控制装置

• 使用第6 代PCIE 滤波器之后的附加相位抖动：

20fs RMS（最大值）

• 使用第5 代PCIE 滤波器之后的附加相位抖动：

25fs RMS（最大值）

• 使用DB2000Q 滤波器之后的附加相位抖动：38fs

RMS（最大值）

3 说明

CDCDB800 是一款符合 DB800ZL 标准的 8 输出 LP-

HCSL 时钟缓冲器，能够为第 1 代到第 6 代 PCIe、

QuickPath Interconnect (QPI)、UPI、SAS 和SATA 接

口分配基准时钟。使用 SMBus 接口和 8 输出使能引

脚，可以单独配置和控制所有 8 个输出。CDCDB800

是一款 DB800ZL 衍生缓冲器，符合或超过 DB800ZL

中的系统参数规格。它还符合或超过了 DB2000Q 的参

数规格。CDCDB800 采用 6mm × 6mm 48 引脚

VQFN 封装。

• 支持公共时钟(CC) 和单独基准(IR) 架构

– 与扩频兼容

• 输出到输出偏斜：< 50ps

• 输入到输出延迟：< 3ns

• 失效防护输入

• 可编程输出转换率控制

• 3.3V 内核和IO 电源电压

• 硬件控制的低功耗模式(PD#)

• 电流消耗：72mA（最大值）

• 6mm × 6mm 48 引脚VQFN 封装

器件信息

封装⁽¹⁾

封装尺寸（标称值）

器件型号

CDCDB800

VQFN (48)

6.00mm × 6.00mm

(1) 如需了解所有可用封装，请参阅数据表末尾的可订购产品附

录。

PCIe PHY

PCIe Gen 4-5

Clock

Generator

LP-HCSL

CDCDB800

8x LP-HSCL Output Buffer

PCIe PHY

PCIe Device

LP-HCSL

OE#

Control

SMBus

Control

Control Interface

CDCDB800 系统图

本文档旨在为方便起见，提供有关TI 产品中文版本的信息，以确认产品的概要。有关适用的官方英文版本的最新信息，请访问

www.ti.com，其内容始终优先。TI 不保证翻译的准确性和有效性。在实际设计之前，请务必参考最新版本的英文版本。

English Data Sheet: SNAS818

12 3 4 5 6 7...34

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型号	品牌	获取价格	描述	数据表
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