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CD4031BCJ PDF预览

CD4031BCJ

更新时间： 2024-11-04 13:00:07
品牌 Logo 应用领域
美国国家半导体 - NSC 移位寄存器
页数 文件大小 规格书
6页 148K
描述
IC 4000/14000/40000 SERIES, 64-BIT RIGHT SERIAL IN SERIAL OUT SHIFT REGISTER, COMPLEMENTARY OUTPUT, CDIP16, CERAMIC, DIP-16, Shift Register

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CD4031BCJ 技术参数

是否Rohs认证：不符合生命周期：Obsolete
包装说明：DIP, DIP16,.3Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.73
Is Samacsys：N其他特性：DELAYED BUFFERED CLOCK OUTPUT FOR CASCADING
计数方向：RIGHT系列：4000/14000/40000
JESD-30 代码：R-GDIP-T16JESD-609代码：e0
长度：19.43 mm负载电容（CL）：50 pF
逻辑集成电路类型：SERIAL IN SERIAL OUT位数：64
功能数量：1端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：COMPLEMENTARY封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DIP封装等效代码：DIP16,.3
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5/15 V
传播延迟（tpd）：600 ns认证状态：Not Qualified
座面最大高度：5.08 mm子类别：Shift Registers
最大供电电压 (Vsup)：15 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：POSITIVE EDGE
宽度：7.62 mm最小 fmax：1.6 MHz
Base Number Matches：1

CD4031BCJ 数据手册

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February 1988  
CD4031BM/CD4031BC  
64-Stage Static Shift Register  
General Description  
Features  
Y
Wide supply voltage range  
3.0V to 15V  
0.45 V (typ.)  
The CD4031BM/CD4031BC is an integrated, complemen-  
tary MOS (CMOS), 64-stage, fully static shift register. Two  
data inputs, DATA IN and RECIRCULATE IN, and a MODE  
CONTROL input are provided. Data at the DATA input  
(when MODE CONTROL is low) or data at the RECIRCU-  
LATE input (when MODE CONTROL is high), which meets  
the setup and hold time requirements, is entered into the  
first stage of the register and is shifted one stage at each  
positive transition of the CLOCK.  
Y
High noise immunity  
DD  
Y
Low power TTL  
compatibility  
fan out of 2 driving 74L  
or 1 driving 74LS  
DC to 8 MHz  
Y
Fully static operation  
e
V
10V (typ.)  
5 pF (typ.)  
input capacitance  
DD  
Y
Fully buffered clock input  
Y
Single phase clocking requirements  
Data output is available in both true and complement forms  
from the 64th stage. Both the DATA OUT (Q) AND DATA  
OUT (Q) outputs are fully buffered.  
Y
Delayed clock output for reduced clock drive require-  
ments  
Y
Y
Y
Fully buffered outputs  
The CLOCK input of the CD4031BM/CD4031BC is fully  
buffered, and present only a standard input load capaci-  
High current sinking capability  
Q output  
1.6 mA  
@
e
V
DD  
5V and 25 C  
§
tance. However, a DELAYED CLOCK OUTPUT (CL ) has  
D
been provided to allow reduced clock drive fan-out and tran-  
sition time requirements when cascading packages.  
Logic and Connection Diagrams  
TL/F/5962–1  
Dual-In-Line Package  
Order Number CD4031B  
TL/F/5962–2  
Top View  
C
1995 National Semiconductor Corporation  
TL/F/5962  
RRD-B30M105/Printed in U. S. A.  
123456

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与CD4031BCJ相关器件

型号 品牌 获取价格 描述 数据表
CD4031BCJ/A+ NSC

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 		IC,SHIFT REGISTER,CMOS,DIP,16PIN,CERAMIC
CD4031BCN NSC

获取价格

 		IC 4000/14000/40000 SERIES, 64-BIT RIGHT SERIAL IN SERIAL OUT SHIFT REGISTER, COMPLEMENTAR
CD4031BCN TI

获取价格

 		4000/14000/40000 SERIES, 64-BIT RIGHT SERIAL IN SERIAL OUT SHIFT REGISTER, COMPLEMENTARY O
CD4031BCN/B+ TI

获取价格

 		IC,SHIFT REGISTER,CMOS,DIP,16PIN,PLASTIC
CD4031BD3 RENESAS

获取价格

 		Serial In Serial Out, 4000/14000/40000 Series, 64-Bit, Right Direction, Complementary Outp
CD4031BE ROCHESTER

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 		4000/14000/40000 SERIES, 64-BIT RIGHT SERIAL IN SERIAL OUT SHIFT REGISTER, COMPLEMENTARY O
CD4031BE TI

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 		CMOS 64 级静态移位寄存器 | N | 16 | -55 to 125
CD4031BEE4 TI

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 		CMOS 64-Stage Static Shift Register 16-PDIP -55 to 125
CD4031BEX RENESAS

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 		Serial In Serial Out, 4000/14000/40000 Series, 64-Bit, Right Direction, Complementary Outp
CD4031BF RENESAS

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 		Serial In Serial Out, 4000/14000/40000 Series, 64-Bit, Right Direction, Complementary Outp

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