BU4015B

更新时间： 2024-09-15 22:27:59

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罗姆 - ROHM		移位寄存器
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描述
Dual 4-bit static shift register

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BU4015B 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP, DIP16,.3	针数：	16
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	8.32	其他特性：	INDIVIDUAL CLOCK & CLEAR FOR EACH SHIFT REGISTER
计数方向：	RIGHT	系列：	4000/14000/40000
JESD-30 代码：	R-PDIP-T16	JESD-609代码：	e2
长度：	19.4 mm	逻辑集成电路类型：	SERIAL IN PARALLEL OUT
位数：	4	功能数量：	2
端子数量：	16	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	DIP
封装等效代码：	DIP16,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	260
电源：	5/15 V	认证状态：	Not Qualified
座面最大高度：	4.55 mm	子类别：	Shift Registers
最大供电电压 (Vsup)：	16 V	最小供电电压 (Vsup)：	3 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin/Copper (Sn/Cu)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	10	触发器类型：	POSITIVE EDGE
宽度：	7.62 mm	Base Number Matches：	1

BU4015B 数据手册

Standard ICs

Dual 4-bit static shift register

BU4015B / BU4015BF

The BU4015B and BU4015BF are 4-stage static shift registers, each consisting of two circuits.

The D flip-flops for each stage share a common reset input, enabling external asynchronous reset at any point.

Also, the flip-flops at each stage are triggered by the rising edge of the clock input.

“H” level reset input resets the contents of all stages to “L”, regardless of the clock and data input, and sets data out-

puts Q0 to Q3 to “L”.

Features

1) Low power dissipation.

•

4) High fan-out.

2) Wide range of operating power supply voltages.

3) High input impedance.

5) Direct drive of 2 L-TTL inputs and 1 LS-TTL input.

Block diagram

Logic circuit diagram

•

Q⁰

CLOCK

VDD

D^B

Q^3B

CLOCK

RESET

Q2B

Q1A

Q0A

Q⁰

Q3 Q2 Q1

RESET

Q0B

Q1B

Q2B

Q3A

Q⁰Q1 Q2

RESET

CLOCK

V^SS

Truth table

•

CLOCK

RESET

Q₀

Q₁

Q₀

Q₂

Q₃

Q₂

Q₁

No Change

X : Irrelevant

12 3 4

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