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BTS54220LBEAUMA1

更新时间： 2024-02-14 09:35:43

品牌	Logo	应用领域
英飞凌 - INFINEON		光电二极管接口集成电路
页数	文件大小	规格书
73页	1522K
描述
Interface Circuit, PDSO24, GREEN, TSON-24

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BTS54220LBEAUMA1 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
包装说明：	HVSON,	Reach Compliance Code：	not_compliant
HTS代码：	8542.39.00.01	Factory Lead Time：	1 week
风险等级：	5.59	其他特性：	SEATED HGT-NOM
接口集成电路类型：	INTERFACE CIRCUIT	JESD-30 代码：	R-PDSO-N24
JESD-609代码：	e3	长度：	9.5 mm
湿度敏感等级：	3	功能数量：	1
端子数量：	24	封装主体材料：	PLASTIC/EPOXY
封装代码：	HVSON	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	NOT SPECIFIED
筛选级别：	AEC-Q100	座面最大高度：	1 mm
最大供电电压：	5.5 V	最小供电电压：	3.8 V
标称供电电压：	4.3 V	电源电压1-最大：	28 V
电源电压1-分钟：	5.5 V	电源电压1-Nom：	13.5 V
表面贴装：	YES	端子面层：	Matte Tin (Sn)
端子形式：	NO LEAD	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	6 mm	Base Number Matches：	1

BTS54220LBEAUMA1 数据手册

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BTS54220-LBE

Serial Peripheral Interface (SPI)

9.7.7

Diagnosis Control Register

Name

W = 1 RB

R = 0

ADDR

Default

DCR

DCR.SBM

DCR.MUX

F7_H

9.7.8

Configuration Register Bit Overview

Field

Bits

Type Description

0_B

1_B

(default) Read / write to OUT register

Read / write to other registers

OUT.OUTn

n = 5 to 1

4:0

1:0

2:1

3:0

Output Control Register of Channel n

0_B

1_B

(default) channel is OFF

Channel is ON

OUT.INSTn

n = 2 to 1

Input Status Monitor Channel n

0_B

1_B

(default) Input signal is “low”

Input signal is “high”

LGCR.LEDn

n = 3 to 2

Set LED Mode for Channel n

0_B

1_B

(default) Channel n is in bulb mode

Channel n is in LED mode

LGCR.GBRn

n = 4 to 1

Gate Back Regulation for Channel n

0_B

1_B

Gate back regulation for Channel n is forced OFF

(default) Gate back regulation for Channel n is active

HWCR.CTC

HWCR.RST

HWCR.STB

HWCR.COL

HWCR.RCR

Clear Thermal Counter

0_B

1_B

(default) Thermal latches are untouched

Command: Clear all thermal latches

Reset Command

0_B

1_B

(default) Normal operation

Execute reset command

Standby Mode

0_B

1_B

Device is awake

(default) Device is in Standby mode

Input Combinatorial Logic Configuration

0_B

1_B

(default) Input signal OR-combined with according OUT register bit¹⁾

Input signal AND-combined with according OUT register bit

Retry Counter Reset

0_B

1_B

(default) Retry Counter is reset only for HWCR.CTC=1 (and V_DDreset)

Retry Counter is reset for every IN-pin or OUT.OUTn “high” to “low”

transition for n_retry< n_retry,maxand also for HWCR.CTC=1 (and V_DDreset)

Data Sheet

Rev. 2.2, 2016-10-10

1...64 65 666768 69 70...73

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