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ATF1504AS-15JC68

更新时间： 2024-10-31 22:33:07
品牌 Logo 应用领域
爱特美尔 - ATMEL /
页数 文件大小 规格书
21页 465K
描述
High- Performance EE CPLD

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ATF1504AS-15JC68 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：LCC包装说明：PLASTIC, MS-018AE, LCC-68
针数：68Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.7
其他特性：64 MACROCELLS; IN-SYSTEM PROGRAMMABLE; JTAG BOUNDARY-SCAN TEST CIRCUITRY最大时钟频率：100 MHz
系统内可编程：YESJESD-30 代码：S-PQCC-J68
JESD-609代码：e0JTAG BST：YES
长度：24.2316 mm湿度敏感等级：3
专用输入次数：I/O 线路数量：48
宏单元数：64端子数量：68
最高工作温度：70 °C最低工作温度：
组织：0 DEDICATED INPUTS, 48 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC68,1.0SQ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：225
电源：3.3/5,5 V可编程逻辑类型：EE PLD
传播延迟：15 ns认证状态：Not Qualified
座面最大高度：4.57 mm子类别：Programmable Logic Devices
最大供电电压：5.25 V最小供电电压：4.75 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：24.2316 mm
Base Number Matches：1

ATF1504AS-15JC68 数据手册

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Features  
• High Density, High Performance Electrically Erasable Complex Programmable Logic  
Device  
– 64 Macrocells  
– 5 Product Terms per Macrocell, Expandable up to 40 per Macrocell  
– 44, 68, 84, 100 pins  
– 7 ns Maximum Pin-to-Pin Delay  
– Registered Operation Up To 100 MHz  
– Enhanced Routing Resources  
• In-System Programmability (ISP) via JTAG  
• Flexible Logic Macrocell  
High-  
Performance  
EE CPLD  
– D/T/Latch Configurable Flip Flops  
– Global and Individual Register Control Signals  
– Global and Individual Output Enable  
– Programmable Output Slew Rate  
– Programmable Output Open Collector Option  
– Maximum Logic utilization by burying a register within a COM output  
• Advanced Power Management Features  
– Automatic 100 µA Stand-By for “Z” Version  
– Pin-Controlled 4 mA Stand-By Mode (Typical)  
– Programmable Pin-Keeper Inputs and I/Os  
– Reduced-Power Feature Per Macrocell  
• Available in Commercial and Industrial Temperature Ranges  
• Available in 44-, 68-, and 84-pin PLCC; 44- and 100-pin TQFP; and 100-pin PQFP  
• Advanced EE Technology  
ATF1504AS  
ATF1504ASZ  
– 100% Tested  
– Completely Reprogrammable  
– 100 Program/Erase Cycles  
– 20 Year Data Retention  
– 2000V ESD Protection  
– 200 mA Latch-Up Immunity  
• JTAG Boundary-Scan Testing to IEEE Std. 1149.1-1990 and 1149.1a-1993 Supported  
• PCI-compliant  
• 3.3 or 5.0V I/O pins  
• Security Fuse Feature  
Enhanced Features  
• Improved Connectivity (Additional Feedback Routing, Alternate Input Routing)  
• Output Enable Product Terms  
• D - Latch Mode  
• Combinatorial Output with Registered Feedback within any Macrocell  
• Three Global Clock Pins  
• ITD (Input Transition Detection) Circuits on Global Clocks, Inputs and I/O  
• Fast Registered Input from Product Term  
• Programmable “Pin-Keeper” Option  
• VCC Power-Up Reset Option  
• Pull-Up Option on JTAG Pins TMS and TDI  
• Advanced Power Management Features  
– Edge Controlled Power Down “L”  
– Individual Macrocell Power Option  
– Disable ITD on Global Clocks, Inputs and I/O  
Description  
The ATF1504AS is a high performance, high density Complex Programmable Logic  
Device (CPLD) which utilizes Atmel’s proven electrically erasable memory technology.  
With 64 logic macrocells and up to 68 inputs, it easily integrates logic from several  
Rev. 0950D–07/98  
(continued)  
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ATF1504AS-15JC68 替代型号

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