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ADSP-BF561SKBCZ500

更新时间： 2024-01-11 00:21:45
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
52页 508K
描述
Blackfin Embedded Symmetric Multi-Processor

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ADSP-BF561SKBCZ500 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：BGA
包装说明：LFBGA, BGA256,16X16,25针数：256
Reach Compliance Code：compliantECCN代码：3A991.A.2
HTS代码：8542.31.00.01风险等级：1.87
其他特性：ALSO OPERATES AT 2.5 OR 3.3 V NOMINAL SUPPLY地址总线宽度：23
桶式移位器：YES位大小：32
边界扫描：YES最大时钟频率：500 MHz
外部数据总线宽度：32格式：FIXED POINT
内部总线架构：MULTIPLEJESD-30 代码：S-PBGA-B256
JESD-609代码：e1长度：12 mm
低功率模式：YES湿度敏感等级：3
端子数量：256最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：LFBGA封装等效代码：BGA256,16X16,25
封装形状：SQUARE封装形式：GRID ARRAY, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：260电源：1.2,2.5/3.3 V
认证状态：Not Qualified座面最大高度：1.7 mm
速度：500 MHz子类别：Microprocessors
最大供电电压：1.375 V最小供电电压：0.8 V
标称供电电压：1.25 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Silver/Copper (Sn96.5Ag3.0Cu0.5)端子形式：BALL
端子节距：0.65 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：40宽度：12 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches：1

ADSP-BF561SKBCZ500 数据手册

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Blackfin® Embedded  
Symmetric Multi-Processor  
a
Preliminary Technical Data  
FEATURES  
ADSP-BF561  
PERIPHERALS  
Dual Symmetric 600 Mhz High Performance Blackfin Core  
328 KBytes of On-chip Memory (See Memory Info on Page 3)  
Each Blackfin Core Includes:  
Two 16-Bit MACs, Two 40-Bit ALUs, Four 8-Bit Video ALUs,  
40-Bit Shifter  
RISC-Like Register and Instruction Model for Ease of Pro-  
gramming and Compiler-Friendly Support  
Advanced Debug, Trace, and Performance- Monitoring  
0.8 - 1.2V core VDD with On-Chip Voltage Regulation  
3.3V and 2.5V Tolerant I/O  
Two Parallel Input/Output Peripheral Interface Units Sup-  
porting ITU-R 656 Video and Glueless Interface to ADI  
Analog Front End ADCs  
Two Dual Channel, Full Duplex Synchronous Serial Ports Sup-  
porting Eight Stereo I2S Channels  
Dual 16 Channel DMA Controllers and one internal memory  
DMA controller  
12 General Purpose 32-bit Timer/Counters, with PWM  
Capability  
SPI-Compatible Port  
UART with Support for IrDA®  
Dual Watchdog Timers  
256-Ball Mini BGA and 297-Ball PBGA Package Options  
48 Programable Flags  
On-Chip Phase Locked Loop Capable of 1x to 63x Frequency  
Multiplication  
IRQ CTRL/  
JTAG TEST  
IRQ CTRL/  
TIMER  
TIMER  
EMULATION  
B B  
VOLTAGE  
REGULATOR  
UART  
IRDA®  
SPI  
L1  
L1  
DATA  
MEMORY  
L1  
L1  
L2 SRAM  
DATA  
MMU  
MMU  
INSTRUCTION  
MEMORY  
INSTRUCTION  
MEMORY  
128 KBYTES  
MEMORY  
SPORT0  
SPORT1  
GPIO  
IMDMA  
CONTROLLER  
CORE SYSTEM / BUS INTERFACE  
EAB  
DMA  
CONTROLLER1  
32  
TIMERS  
DMA  
CONTROLLER2  
DAB  
PAB  
16  
BOOT ROM  
16  
32  
DAB  
EXTERNAL PORT  
FLASH/SDRAM CONTROL  
PPI  
PPI  
Figure 1. Functional Block Diagram  
Blackfin and the Blackfin logo are registered trademarks of Analog Devices, Inc.  
Rev. PrC  
Information furnished by Analog Devices is believed to be accurate and reliable.  
However, no responsibility is assumed by Analog Devices for its use, nor for any  
infringements of patents or other rights of third parties that may result from its use.  
Specifications subject to change without notice. No license is granted by implication  
or otherwise under any patent or patent rights of Analog Devices. Trademarks and  
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Tel:781/329-4700  
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www.analog.com  
© 2004 Analog Devices, Inc. All rights reserved.  
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