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Datasheet > 微控制器和处理器 > 数字信号处理器> ADSP-BF561SBBZ600
ADSP-BF561SBBZ600 PDF预览

ADSP-BF561SBBZ600

更新时间： 2024-02-11 19:50:10
品牌 Logo 应用领域
亚德诺 - ADI 微控制器和处理器外围集成电路数字信号处理器时钟
页数 文件大小 规格书
60页 2865K
描述
Blackfin Embedded Symmetric Multiprocessor

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ADSP-BF561SBBZ600 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：BGA
包装说明：BGA,针数：297
Reach Compliance Code：unknown风险等级：5.6
其他特性：ALSO OPERATES AT 2.5 OR 3.3 V NOMINAL SUPPLY地址总线宽度：23
桶式移位器：YES边界扫描：YES
最大时钟频率：600 MHz外部数据总线宽度：32
格式：FIXED POINT内部总线架构：MULTIPLE
JESD-30 代码：S-PBGA-B297JESD-609代码：e1
长度：27 mm低功率模式：YES
湿度敏感等级：3端子数量：297
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装形状：SQUARE封装形式：GRID ARRAY
峰值回流温度（摄氏度）：260认证状态：COMMERCIAL
座面最大高度：2.43 mm最大供电电压：1.4185 V
最小供电电压：0.8 V标称供电电压：1.35 V
表面贴装：YES温度等级：INDUSTRIAL
端子面层：TIN SILVER COPPER端子形式：BALL
端子节距：1 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：40宽度：27 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches：1

ADSP-BF561SBBZ600 数据手册

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Blackfin® Embedded  
Symmetric Multiprocessor  
a
ADSP-BF561  
FEATURES  
PERIPHERALS  
Dual symmetric 600 MHz high performance Blackfin cores  
328K bytes of on-chip memory (see memory information  
on Page 4)  
Two parallel input/output peripheral interface units support-  
ing ITU-R 656 video and glueless interface to analog front  
end ADCs  
Two dual channel, full duplex synchronous serial ports sup-  
porting eight stereo I2S channels  
Dual 16-channel DMA controllers and one internal memory  
DMA controller  
12 general-purpose 32-bit timers/counters, with PWM  
capability  
SPI®-compatible port  
UART with support for IrDA®  
Each Blackfin core includes:  
Two 16-bit MACs, two 40-bit ALUs, four 8-bit video ALUs,  
40-bit shifter  
RISC-like register and instruction model for ease of program-  
ming and compiler-friendly support  
Advanced debug, trace, and performance monitoring  
0.8 V to 1.35 V core VDD with on-chip voltage regulator  
3.3 V and 2.5 V compliant I/O  
Dual watchdog timers  
256-ball mini-BGA and 297-ball PBGA package options  
48 programmable flags  
On-chip phase-locked loop capable of 0.5× to 64× frequency  
multiplication  
IRQ CONTROL/  
WATCHDOG  
TIMER  
JTAG TEST  
IRQ CONTROL/  
EMULATION  
WATCHDOG  
TIMER  
B B  
VOLTAGE  
REGULATOR  
UART  
IrDA  
SPI  
L1  
L1  
L1  
L1  
L2 SRAM  
128K BYTES  
DATA  
MEMORY  
DATA  
MEMORY  
MMU  
MMU  
INSTRUCTION  
MEMORY  
INSTRUCTION  
MEMORY  
SPORT0  
SPORT1  
GPIO  
IMDMA  
CONTROLLER  
CORE SYSTEM/BUS INTERFACE  
EAB  
DMA  
CONTROLLER1  
32  
TIMERS  
DMA  
CONTROLLER2  
DEB  
DAB  
PAB  
16  
BOOT ROM  
32  
16  
DAB  
EXTERNAL PORT  
FLASH/SDRAM CONTROL  
PPI0  
PPI1  
Figure 1. Functional Block Diagram  
Blackfin and the Blackfin logo are registered trademarks of Analog Devices, Inc.  
Rev. A  
Information furnished by Analog Devices is believed to be accurate and reliable.  
However, no responsibility is assumed by Analog Devices for its use, nor for any  
infringements of patents or other rights of third parties that may result from its use.  
Specifications subject to change without notice. No license is granted by implication  
or otherwise under any patent or patent rights of Analog Devices. Trademarks and  
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One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106 U.S.A.  
Tel: 781.329.4700  
Fax: 781.461.3113  
www.analog.com  
© 2006 Analog Devices, Inc. All rights reserved.  
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