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ADCLK854BCPZ-REEL7

更新时间： 2024-02-14 12:16:57

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亚德诺 - ADI		时钟
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16页	532K
描述
1.8 V, 12-LVDS/24-CMOS Output, Low Power Clock Fanout Buffer

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ADCLK854BCPZ-REEL7 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	48
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	1.02
放大器类型：	BUFFER	最大平均偏置电流 (IIB)：	350 µA
JESD-30 代码：	S-XQCC-N48	JESD-609代码：	e3
长度：	7 mm	湿度敏感等级：	3
功能数量：	1	端子数量：	48
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	1 mm	子类别：	Buffer Amplifier
供电电压上限：	2 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	40	宽度：	7 mm
Base Number Matches：	1

ADCLK854BCPZ-REEL7 数据手册

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ADCLK854

CLOCK CHARACTERISTICS

Table 3. Clock Output Phase Noise

Parameter

Min

Typ

Max

Unit

Conditions

CLOCK-TO-LVDS ABSOLUTE PHASE NOISE

1000 MHz

Input slew rate > 1 V/ns

@ 10 Hz offset

@ 100 Hz offset

@ 1 kHz offset

@ 10 kHz offset

@ 100 kHz offset

@ 1 MHz offset

@ 10 MHz offset

Input slew rate > 1 V/ns

@ 10 Hz offset

@ 100 Hz offset

@ 1 kHz offset

@ 10 kHz offset

@ 100 kHz offset

@ 1 MHz offset

@ 10 MHz offset

−90

dBc/Hz

−108

−117

−126

−135

−141

−146

CLOCK-TO-CMOS ABSOLUTE PHASE NOISE

200 MHz

−101

−119

−127

−138

−147

−153

−156

dBc/Hz

LOGIC AND POWER CHARACTERISTICS

Table 4. Control Pin Characteristics

Parameter

CONTROL PINS (IN_SEL, CTRL_x, SLEEP)¹

Symbol Min

Typ Max Unit

Conditions

Logic 1 Voltage

Logic 0 Voltage

Logic 1 Current

Logic 0 Current

V_IH

V_IL

I_IH

V_S− 0.4

ꢁA

0.4

−5

I_IL

Capacitance

POWER

Supply Voltage Requirement

LVDS Outputs

V_S

1.71

1.8

1.89

100

V_S= 1.8 V 5%

Full operation

All outputs enabled as LVDS and loaded, R_L= 100 ꢀ

Full operation

LVDS @ 100 MHz

LVDS @ 1200 MHz

CMOS Outputs

CMOS @ 100 MHz

CMOS @ 250 MHz

SLEEP

175 215

115 140

265 325

All outputs enabled as CMOS and loaded, C_L= 10 pF

SLEEP pin pulled high; does not include power dissipated

in the external resistors

Power Supply Rejection ²

LVDS

0.9

1.2

ps/mV

PSR_t

CMOS

¹These pins each have a 200 kΩ internal pull-down resistor.

²Change in t_PDper change in V_S.

Rev. 0 | Page 5 of 16

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