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97SD3240RPMK

更新时间： 2024-02-26 15:43:20

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麦斯威 - MAXWELL		动态存储器
页数	文件大小	规格书
39页	741K
描述
Synchronous DRAM, 32MX40, 6ns, CMOS, STACK, QFP-132

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97SD3240RPMK 技术参数

生命周期：	Obsolete	包装说明：	GQFF, QFL132,1.35SQ,25
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.36	风险等级：	5.7
Is Samacsys：	N	访问模式：	FOUR BANK PAGE BURST
最长访问时间：	6 ns	其他特性：	AUTO/SELF REFRESH
最大时钟频率 (fCLK)：	133.33 MHz	I/O 类型：	COMMON
交错的突发长度：	1,2,4,8	JESD-30 代码：	S-XQFP-F132
长度：	34.29 mm	内存密度：	1342177280 bit
内存集成电路类型：	SYNCHRONOUS DRAM	内存宽度：	40
功能数量：	1	端口数量：	1
端子数量：	132	字数：	33554432 words
字数代码：	32000000	工作模式：	SYNCHRONOUS
最高工作温度：	125 °C	最低工作温度：	-55 °C
组织：	32MX40	封装主体材料：	UNSPECIFIED
封装代码：	GQFF	封装等效代码：	QFL132,1.35SQ,25
封装形状：	SQUARE	封装形式：	FLATPACK, GUARD RING
认证状态：	Not Qualified	刷新周期：	8192
反向引出线：	NO	自我刷新：	YES
连续突发长度：	1,2,4,8	最大待机电流：	0.15 A
最小待机电流：	3 V	最大压摆率：	0.575 mA
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	3 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	MILITARY
端子形式：	FLAT	端子节距：	0.635 mm
端子位置：	QUAD	总剂量：	100k Rad(Si) V
宽度：	34.29 mm	Base Number Matches：	1

97SD3240RPMK 数据手册

97SD3240

1.25Gb (8-Meg X 40-Bit X 4-Banks) SDRAM

Column address strobe and write command (WRIT): This command starts a write operation. When the

burst write mode is selected, the column address (AY0 to AY9) and the bank select address (BA0/BA1)

become the burst write start address. When the single write mode is selected, data is only written to the

location specified by the column address (AY0 to AY9) and bank select address(BA0/BA1).

Write with auto-precharge (WRIT A): This command automatically performs a precharge operation after a

burst write with a length of 1, 2, 4, or 8, or after a single write operation.

Row address strobe and bank activate ( ACTV): This command activates the bank that is selected by

BA0/BA1 (BS) and determines the row address (AX0 to AX12). When BA0 and BA1 are Low, bank 0 is

activated. When BA0 is Low, and BA1 is High, bank 1 is activated. When BA0 is High and BA1 is Low, bank

2 is activated. When BA0 and BA1 are High, bank 3 is activated.

Precharge select bank (PRE): This command starts precharge operation for the bank selected by BA0/

BA1. If BA0 and BA1 are Low, bank 0 is selected. If BA0 is Low and BA1 is High, bank 1 is selected. If BA0

is High and BA1 is Low, bank 2 is selected. If BA0 and BA1 are High, bank 3 is selected.

Precharge all banks (PALL): This command starts a precharge operation for all banks.

Refresh (REF/SELF): This command starts the refresh operation. There are two types of refresh

operations; one is auto-refresh, and the other is self-refresh. For details, refer to the CKE truth table section.

Mode register set (MRS): The SDRAM has a mode register that defines how it operates. The mode register

is specified by the address pins (A0 to A12, BA0 andBA1) at the mode register set cycle. For details, refer to

the mode register configuration. After power on, the contents of the mode register are undefined, execute

the mode register set command to set up the mode register.

02.04.05 Rev 3

All data sheets are subject to change without notice

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