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853S111BKILFT

更新时间： 2024-02-13 07:10:07

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艾迪悌 - IDT		驱动逻辑集成电路
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25页	451K
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Low Skew, 1-to-10, Differential-to-2.5V, 3.3V LVPECL/ECL Fanout Buffer

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853S111BKILFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	VFQFPN
包装说明：	VFQFN-32	针数：	32
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.66
Samacsys Description：	VFQFP-N 5 X 5 NO LEAD	系列：	853S
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-XQCC-N32
JESD-609代码：	e3	长度：	5 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	湿度敏感等级：	3
功能数量：	1	反相输出次数：
端子数量：	32	实输出次数：	10
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装等效代码：	LCC32,.2SQ,20	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
电源：	+-2.5/+-3.3 V	Prop。Delay @ Nom-Sup：	0.645 ns
传播延迟（tpd）：	0.61 ns	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.05 ns	座面最大高度：	1 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.8 V
最小供电电压 (Vsup)：	2.375 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn) - annealed	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	5 mm
最小 fmax：	2500 MHz	Base Number Matches：	1

853S111BKILFT 数据手册

853S111B Datasheet

Additive Phase Jitter

The spectral purity in a band at a specific offset from the fundamental

compared to the power of the fundamental is called the dBc Phase

Noise. This value is normally expressed using a Phase noise plot

and is most often the specified plot in many applications. Phase noise

is defined as the ratio of the noise power present in a 1Hz band at a

specified offset from the fundamental frequency to the power value of

the fundamental. This ratio is expressed in decibels (dBm) or a ratio

of the power in the 1Hz band to the power in the fundamental. When

the required offset is specified, the phase noise is called a dBc value,

which simply means dBm at a specified offset from the fundamental.

By investigating jitter in the frequency domain, we get a better

understanding of its effects on the desired application over the entire

time record of the signal. It is mathematically possible to calculate an

expected bit error rate given a phase noise plot.

Additive Phase Jitter @ 155.52MHz

12kHz to 20MHz = 0.03ps (typical)

Offset from Carrier Frequency (Hz)

As with most timing specifications, phase noise measurements have

issues relating to the limitations of the equipment. Often the noise

floor of the equipment is higher than the noise floor of the device. This

is illustrated above. The device meets the noise floor of what is

shown, but can actually be lower. The phase noise is dependent on

the input source and measurement equipment.

Rohde & Schwarz SMA100A Signal Generator 9kHz - 6GHz as

external input to a Hewlett Packard 8133A 3GHz Pulse Generator.

Revision F, January 14, 2016

1...6 7 8910 11 12...25

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与853S111BKILFT相关器件

型号	品牌	描述	获取价格	数据表
853S111BKILW	IDT	Low Skew Different ial-to-2 .5V, 3.3V LVPECL/ECL	获取价格
853S111BYILF	IDT	Low Skew, 1-to-10, Differential-to-2.5V, 3.3V LVPECL/ECL Fanout Buffer	获取价格
853S111BYILFT	IDT	Low Skew, 1-to-10, Differential-to-2.5V, 3.3V LVPECL/ECL Fanout Buffer	获取价格
853S12AKI	IDT	Low Skew Clock Driver, 853S Series, 12 True Output(s), 0 Inverted Output(s), 5 MM X 5 MM,	获取价格
853S12AKIT	IDT	Low Skew Clock Driver, 853S Series, 12 True Output(s), 0 Inverted Output(s), 5 MM X 5 MM,	获取价格
853S12I	RENESAS	Low Skew,1-to-12,Differential-to-3.3V,2.5V LVPECL Fanout Buffer	获取价格

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