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74HC4075PW-Q100

更新时间： 2024-11-24 20:06:39
品牌 Logo 应用领域
恩智浦 - NXP 栅光电二极管逻辑集成电路
页数 文件大小 规格书
13页 123K
描述
IC OR GATE, Gate

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74HC4075PW-Q100 技术参数

生命周期：Transferred零件包装代码：TSSOP
包装说明：TSSOP,针数：14
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.65系列：HC/UH
JESD-30 代码：R-PDSO-G14长度：5 mm
逻辑集成电路类型：OR GATE功能数量：3
输入次数：3端子数量：14
最高工作温度：125 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
传播延迟（tpd）：150 ns筛选级别：AEC-Q100
座面最大高度：1.1 mm最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
宽度：4.4 mmBase Number Matches：1

74HC4075PW-Q100 数据手册

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74HC4075-Q100;  
74HCT4075-Q100  
Triple 3-input OR gate  
Rev. 1 — 22 May 2013  
Product data sheet  
1. General description  
The 74HC4075-Q100; 74HCT4075-Q100 is a triple 3-input OR gate. Inputs include clamp  
diodes. This enables the use of current limiting resistors to interface inputs to voltages in  
excess of VCC  
.
This product has been qualified to the Automotive Electronics Council (AEC) standard  
Q100 (Grade 1) and is suitable for use in automotive applications.  
2. Features and benefits  
Automotive product qualification in accordance with AEC-Q100 (Grade 1)  
Specified from 40 C to +85 C and from 40 C to +125 C  
Complies with JEDEC standard JESD7A  
Input levels:  
For 74HC4075-Q100: CMOS level  
For 74HCT4075-Q100: TTL level  
ESD protection:  
MIL-STD-883, method 3015 exceeds 2000 V  
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V (C = 200 pF, R = 0 )  
Multiple package options  
3. Ordering information  
Table 1.  
Ordering information  
Type number  
Package  
Temperature range Name  
Description  
Version  
74HC4075D-Q100  
74HCT4075D-Q100  
40 C to +125 C  
SO14  
plastic small outline package; 14 leads;  
body width 3.9 mm  
SOT108-1  
74HC4075PW-Q100 40 C to +125 C  
TSSOP14  
plastic thin shrink small outline package;  
14 leads; body width 4.4 mm  
SOT402-1  
74HCT4075PW-Q100  
 
 
 
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型号 品牌 获取价格 描述 数据表
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