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74F269SPCQR

更新时间： 2024-02-12 23:52:42
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 计数器
页数 文件大小 规格书
6页 71K
描述
Binary Counter, F/FAST Series, Synchronous, Positive Edge Triggered, 8-Bit, Bidirectional, TTL, PDIP24, 0.300 INCH, SLIM, PLASTIC, DIP-24

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74F269SPCQR 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：DIP,针数：24
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.72其他特性：TCO OUTPUT
计数方向：BIDIRECTIONAL系列：F/FAST
JESD-30 代码：R-PDIP-T24JESD-609代码：e3
长度：31.915 mm负载/预设输入：YES
逻辑集成电路类型：BINARY COUNTER工作模式：SYNCHRONOUS
位数：8功能数量：1
端子数量：24最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE传播延迟（tpd）：11 ns
认证状态：Not Qualified座面最大高度：5.08 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：TTL温度等级：COMMERCIAL
端子面层：MATTE TIN端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
触发器类型：POSITIVE EDGE宽度：7.62 mm
最小 fmax：85 MHzBase Number Matches：1

74F269SPCQR 数据手册

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AC Electrical Characteristics  
T
A = +25°C  
T
A = 0°C to +70°C  
VCC = 5.0V  
V
CC = +5.0V  
Symbol  
Parameter  
Units  
CL = 50 pF  
CL = 50 pF  
Min  
100  
3.5  
4.5  
3.5  
4.5  
3.5  
3.0  
4.5  
5.0  
3.5  
4.5  
3.5  
4.0  
Typ  
Max  
Min Max  
fMAX  
Maximum Clock Frequency  
85  
3.5  
4.5  
3.5  
4.5  
3.5  
3.0  
4.5  
4.5  
3.5  
4.5  
3.5  
4.0  
MHz  
ns  
tPLH  
tPHL  
tPLH  
tPHL  
tPLH  
tPHL  
tPLH  
tPHL  
tPLH  
tPHL  
tPLH  
tPHL  
Propagation Delay  
CP to Qn (Count-Up)  
Propagation Delay  
U/D to TC  
8.0  
10.5  
7.5  
7.0  
11.0  
10.0  
11.0  
10.5  
11.5  
10.5  
10.5  
11.0  
11.0  
10.0  
7.0  
ns  
ns  
ns  
ns  
ns  
7.5  
Propagation Delay  
CET to TC  
7.0  
10.5  
10.0  
10.0  
10.5  
10.5  
7.0  
Propagation Delay  
CP to TC  
Propagation Delay  
CP to Qn (Count-Down)  
Propagation Delay  
CP to Qn (Load)  
7.0  
AC Operating Requirements  
T
A = +25°C  
CC = +5.0V  
Max  
T
A = 0°C to +70°C  
CC = 5.0V  
Min Max  
Symbol  
Parameter  
V
V
Units  
Min  
3.5  
3.0  
1.0  
1.0  
5.5  
5.5  
0
tS(H)  
Setup Time, HIGH or LOW  
Data to CP  
4.0  
3.0  
2.0  
1.0  
6.5  
6.5  
0
tS(L)  
tH(H)  
ns  
Hold Time, HIGH or LOW  
Data to CP  
t
H(L)  
tS(H)  
tS(L)  
Setup Time, HIGH or LOW  
PE to CP  
ns  
ns  
t
t
H(H)  
H(L)  
Hold Time, HIGH or LOW  
PE to CP  
0
0
tS(H)  
tS(L)  
tH(H)  
tH(L)  
Setup Time, HIGH or LOW  
CET or CEP to CP  
Hold Time, HIGH or LOW  
CET or CEP to CP  
6.0  
8.0  
0
6.5  
9.0  
0
0
0
t
t
W(H)  
W(L)  
Clock Pulse Width, HIGH or LOW  
3.5  
3.5  
8.0  
6.0  
0.0  
0.0  
3.5  
4.0  
9.5  
7.0  
0.0  
0.0  
ns  
ns  
ns  
tS(H)  
tS(L)  
tH(H)  
tH(L)  
Setup Time, HIGH or LOW  
U/D to CP  
Hold Time, HIGH or LOW  
U/D to CP  
www.fairchildsemi.com  
4
123456

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