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74AUC1G08GV

更新时间： 2024-01-14 00:42:47

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恩智浦 - NXP		栅极逻辑集成电路光电二极管
页数	文件大小	规格书
12页	54K
描述
Single 2-input AND gate

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技术参数
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74AUC1G08GV 技术参数

生命周期：	Obsolete	零件包装代码：	SOT-353
包装说明：	TSSOP,	针数：	5
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.62	系列：	AUC
JESD-30 代码：	R-PDSO-G5	长度：	2 mm
逻辑集成电路类型：	AND GATE	功能数量：	1
输入次数：	2	端子数量：	5
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
传播延迟（tpd）：	3.3 ns	认证状态：	Not Qualified
座面最大高度：	1.1 mm	最大供电电压 (Vsup)：	2.7 V
最小供电电压 (Vsup)：	0.8 V	标称供电电压 (Vsup)：	1.2 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
宽度：	1.25 mm

74AUC1G08GV 数据手册

Philips Semiconductors

Preliminary speciﬁcation

Single 2-input AND gate

74AUC1G08

FUNCTION TABLE

See note 1.

INPUT

OUTPUT

Note

1. H = HIGH voltage level;

L = LOW voltage level.

ORDERING INFORMATION

TYPE NUMBER

PACKAGE

TEMPERATURE

PINS

PACKAGE MATERIAL

CODE

MARKING

RANGE

74AUC1G08GW

74AUC1G08GV

−40 to +85 °C

SC-88A

SC-74A

plastic

SOT353

SOT753

F08

PINNING

SYMBOL

DESCRIPTION

data input B

data input A

ground (0 V)

data output Y

supply voltage

GND

V_CC

handbook, halfpage

GND

MNA113

MNA112

Fig.1 Pin configuration.

Fig.2 Logic symbol.

2002 Nov 12

1 234 5 6 7...12

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与74AUC1G08GV相关器件

型号	品牌	获取价格	描述	数据表
74AUC1G08GW	NXP	获取价格	Single 2-input AND gate
74AUC1G125DBVRE4	TI	获取价格	SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT
74AUC1G125DBVRG4	TI	获取价格	SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT
74AUC1G125DCKRE4	TI	获取价格	SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT
74AUC1G125DCKRG4	TI	获取价格	SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT
74AUC1G126DBVRE4	TI	获取价格	SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT
74AUC1G126DBVRG4	TI	获取价格	SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT
74AUC1G126DCKRE4	TI	获取价格	SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT
74AUC1G126DCKRG4	TI	获取价格	SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT
74AUC1G240DBVRE4	TI	获取价格	SINGLE BUFFER/DRIVER WITH 3-STATE OUTPUT