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74ALVCH16373DL,112

更新时间： 2024-11-18 14:47:03
品牌 Logo 应用领域
恩智浦 - NXP /
页数 文件大小 规格书
18页 126K
描述
74ALVCH16373 - 2.5 V/3.3 V 16-bit D-type transparent latch; 3-state SSOP 48-Pin

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74ALVCH16373DL,112 技术参数

是否Rohs认证：符合生命周期：Transferred
零件包装代码：SSOP包装说明：PLASTIC, SSOP3-48
针数：48Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.28
Is Samacsys：N其他特性：CAN ALSO OPERATES AT 3 TO 3.6 V RANGE
系列：ALVC/VCX/AJESD-30 代码：R-PDSO-G48
JESD-609代码：e4长度：15.875 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.024 A湿度敏感等级：1
位数：8功能数量：2
端口数量：2端子数量：48
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装等效代码：SSOP48,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH包装方法：TUBE
峰值回流温度（摄氏度）：260电源：3.3 V
Prop。Delay @ Nom-Sup：3.3 ns传播延迟（tpd）：3.9 ns
认证状态：Not Qualified座面最大高度：2.8 mm
子类别：FF/Latches最大供电电压 (Vsup)：2.7 V
最小供电电压 (Vsup)：2.3 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：NICKEL PALLADIUM GOLD
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：7.5 mmBase Number Matches：1

74ALVCH16373DL,112 数据手册

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74ALVCH16373  
2.5 V/3.3 V 16-bit D-type transparent latch; 3-state  
Rev. 6 — 10 July 2012  
Product data sheet  
1. General description  
The 74ALVCH16373 is 16-bit D-type transparent latch featuring separate D-type inputs for  
each latch and 3-state outputs for bus oriented applications.  
Incorporates bus hold data inputs which eliminate the need for external pull-up or  
pull-down resistors to hold unused inputs.  
One latch enable (LE) input and one output enable (OE) are provided per 8-bit section.  
The 74ALVCH16373 consists of 2 sections of eight D-type transparent latches with 3-state  
true outputs. When LE is HIGH, data at the nDn inputs enter the latches. In this condition  
the latches are transparent, therefore a latch output will change each time its  
corresponding D-input changes.  
When LE is LOW, the latches store the information that was present at the nDn inputs at a  
set-up time preceding the LOW-to-HIGH transition of LE. When OE is LOW, the contents  
of the eight latches are available at the outputs. When OE is HIGH, the outputs go to the  
high-impedance OFF-state. Operation of the OE input does not affect the state of the  
latches.  
2. Features and benefits  
Wide supply voltage range from 1.2 V to 3.6 V  
Complies with JEDEC standard JESD8-B  
CMOS low power consumption  
MULTIBYTE flow-through standard pin-out architecture  
Low inductance multiple VCC and GND pins for minimum noise and ground bounce  
Direct interface with TTL levels  
All data inputs have bus hold  
Output drive capability 50 transmission lines at 85 C  
Current drive 24 mA at VCC = 3.0 V  
 
 
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74ALVCH16373DL,112 替代型号

型号 品牌 替代类型 描述 数据表
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