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74ACQ273SCQR

更新时间： 2024-09-16 20:21:11
品牌 Logo 应用领域
美国国家半导体 - NSC 光电二极管输出元件逻辑集成电路触发器
页数 文件大小 规格书
12页 197K
描述
IC AC SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20, SOIC-20, FF/Latch

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74ACQ273SCQR 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：SOIC-20Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.91
Is Samacsys：N系列：AC
JESD-30 代码：R-PDSO-G20JESD-609代码：e0
长度：12.8 mm负载电容（CL）：50 pF
逻辑集成电路类型：D FLIP-FLOP最大频率@ Nom-Sup：75000000 Hz
最大I（ol）：0.012 A位数：8
功能数量：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP20,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：3.3/5 V
认证状态：Not Qualified座面最大高度：2.65 mm
子类别：FF/Latches最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：7.5 mm
Base Number Matches：1

74ACQ273SCQR 数据手册

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March 1993  
74ACQ273 54ACTQ/74ACTQ273  
#
Quiet Series Octal D Flip-Flop  
General Description  
The ’AC/’ACT273 has eight edge-triggered D-type flip-flops  
with individual D inputs and Q outputs. The common buff-  
ered Clock (CP) and Master Reset (MR) input load and re-  
set (clear) all flip-flops simultaneously.  
threshold performance. FACT Quiet SeriesTM features  
GTOTM output control and undershoot corrector in addition  
to a split ground bus for superior performance.  
Features  
Y
CC  
The register is fully edge-triggered. The state of each D in-  
put, one setup time before the LOW-to-HIGH clock tran-  
sition, is transferred to the corresponding flip-flop’s Q out-  
put.  
I
reduced by 50%  
Y
Guaranteed simultaneous switching noise level and  
dynamic threshold performance  
Y
Y
Y
Y
Y
Y
Y
All outputs will be forced LOW independently of Clock or  
Data inputs by a LOW voltage level on the MR input. The  
device is useful for applications where the true output only is  
required and the Clock and Master Reset are common to all  
storage elements.  
Guaranteed pin-to-pin skew AC performance  
Improved latch-up immunity  
Buffered common clock and asynchronous master reset  
Outputs source/sink 24 mA  
Faster prop delays than the standard ’AC/’ACT273  
4 kV minimum ESD immunity  
The ’ACQ/’ACTQ utilizes NSC Quiet Series technology to  
guarantee quiet output switching and improved dynamic  
Standard Military Drawing (SMD)  
Ð ’ACTQ273: 5962-89735  
Logic Symbols  
Connection Diagrams  
Pin Assignment  
for DIP, Flatpak and SOIC  
IEEE/IEC  
TL/F/10585–1  
TL/F/10585–3  
TL/F/10585–2  
Pin Names  
Description  
Pin Assignment  
for LCC  
D –D  
0
Data Inputs  
7
MR  
CP  
Master Reset  
Clock Pulse Input  
Data Outputs  
Q –Q  
0
7
FACTTM, FACT Quiet SeriesTM, and GTOTM are trademarks of National Semiconductor Corporation.  
TL/F/10585–4  
C
1995 National Semiconductor Corporation  
TL/F/10585  
RRD-B30M75/Printed in U. S. A.  
1234567...12

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型号 品牌 获取价格 描述 数据表
74ACQ273SCX TI

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 		AC SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20, 0.300 INCH, PLASTIC,
74ACQ273SJQR TI

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