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72V291L10PFG8

更新时间： 2024-11-08 00:47:51

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艾迪悌 - IDT		时钟先进先出芯片内存集成电路
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3.3 VOLT CMOS SuperSync FIFO

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72V291L10PFG8 技术参数

生命周期：	Active	包装说明：	GREEN, PLASTIC, TQFP-64
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.71	风险等级：	5.73
最长访问时间：	6.5 ns	最大时钟频率 (fCLK)：	100 MHz
周期时间：	10 ns	JESD-30 代码：	S-PQFP-G64
JESD-609代码：	e3	长度：	14 mm
内存密度：	1179648 bit	内存集成电路类型：	OTHER FIFO
内存宽度：	9	功能数量：	1
端子数量：	64	字数：	131072 words
字数代码：	128000	工作模式：	SYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	128KX9	可输出：	YES
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装等效代码：	QFP64,.63SQ,32	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE	并行/串行：	PARALLEL
座面最大高度：	1.6 mm	最大待机电流：	0.02 A
最大压摆率：	0.055 mA	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	3 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	QUAD	宽度：	14 mm
Base Number Matches：	1

72V291L10PFG8 数据手册

3.3 VOLT CMOS SuperSync FIFO™

65,536 x 9

131,072 x 9

IDT72V281

IDT72V291

• Independent Read and Write clocks (permit reading and writing

simultaneously)

• Available in the 64-pin Thin Quad Flat Pack (TQFP) and the 64-pin

Slim Thin Quad Flat Pack (STQFP)

• High-performance submicron CMOS technology

• Industrial Temperature Range (-40°C to + 85°C) is available

• Green parts available, see ordering information

FEATURES:

• Choose among the following memory organizations:

IDT72V281

IDT72V291

65,536 x 9

131,072 x 9

• Pin-compatible with the IDT72V261/72V271 SuperSync FIFOs

• 10ns read/write cycle time (6.5ns access time)

• Fixed, low first word data latency time

• Auto power down minimizes standby power consumption

• Master Reset clears entire FIFO

• Partial Reset clears data, but retains programmable

settings

• Retransmit operation with fixed, low first word data

latency time

DESCRIPTION:

The IDT72V281/72V291 are exceptionally deep, high speed, CMOS

First-In-First-Out (FIFO) memories with clocked read and write controls.

These FIFOs offer numerous improvements over previous SuperSync

FIFOs,includingthefollowing:

• Empty, Full and Half-Full flags signal FIFO status

• Programmable Almost-Empty and Almost-Full flags, each flag can

default to one of two preselected offsets

• Thelimitationofthefrequencyofoneclockinputwithrespecttotheotherhas

been removed. The Frequency Select pin (FS) has been removed, thus

it is no longer necessary to select which of the two clock inputs, RCLK or

WCLK, is running at the higher frequency.

• Program partial flags by either serial or parallel means

• Select IDT Standard timing (using EF and FF flags) or First Word • The period required by the retransmit operation is now fixed and short.

Fall Through timing (using OR and IR flags)

• Output enable puts data outputs into high impedance state

• Easily expandable in depth and width

• Thefirstworddatalatencyperiod,fromthetimethefirstwordiswrittentoan

emptyFIFOtothetimeitcanberead,isnowfixedandshort. (Thevariable

clock cycle counting delay associated with the latency period found on

previousSuperSyncdeviceshasbeeneliminatedonthisSuperSyncfamily.)

FUNCTIONAL BLOCK DIAGRAM

D0-D8

WEN

WCLK

SEN

OFFSET REGISTER

INPUT REGISTER

FF/IR

PAF

EF/OR

PAE

FLAG

LOGIC

WRITE CONTROL

LOGIC

FWFT/SI

RAM ARRAY

65,536 x 9

131,072 x 9

WRITE POINTER

READ POINTER

READ

CONTROL

LOGIC

OUTPUT REGISTER

MRS

PRS

RESET

LOGIC

RCLK

REN

Q0-Q8

4513 drw 01

IDTandtheIDTlogoareregisteredtrademarksofIntegratedDeviceTechnology, Inc. TheSuperSyncFIFOisatrademarkofIntegratedDeviceTechnology, Inc.

COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES

OCTOBER2014

DSC-4513/4

12 3 4 5 6 7...26

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型号	品牌	获取价格	描述	数据表
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72V291L10PFGI8	IDT	获取价格	3.3 VOLT CMOS SuperSync FIFO
72V291L10TF8	IDT	获取价格	TQFP-64, Reel
72V291L10TFG	IDT	获取价格	3.3 VOLT CMOS SuperSync FIFO
72V291L10TFG8	IDT	获取价格	3.3 VOLT CMOS SuperSync FIFO
72V291L10TFGI	IDT	获取价格	3.3 VOLT CMOS SuperSync FIFO
72V291L10TFGI8	IDT	获取价格	3.3 VOLT CMOS SuperSync FIFO
72V291L15PF	IDT	获取价格	TQFP-64, Tray
72V291L15PFG	IDT	获取价格	3.3 VOLT CMOS SuperSync FIFO
72V291L15PFG8	IDT	获取价格	FIFO, 128KX9, 10ns, Synchronous, CMOS, PQFP64, GREEN, PLASTIC, TQFP-64

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