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70V18L15PFG8

更新时间： 2024-11-27 19:09:39
品牌 Logo 应用领域
艾迪悌 - IDT 静态存储器内存集成电路
页数 文件大小 规格书
18页 641K
描述
Dual-Port SRAM, 64KX9, 15ns, CMOS, PQFP100, 14 X 14 MM, 1.40 MM HEIGHT, GREEN, TQFP-100

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70V18L15PFG8 技术参数

生命周期：Obsolete包装说明：QFP,
Reach Compliance Code：compliantHTS代码：8542.32.00.41
风险等级：5.82最长访问时间：15 ns
JESD-30 代码：S-PQFP-G100内存密度：589824 bit
内存集成电路类型：DUAL-PORT SRAM内存宽度：9
功能数量：1端子数量：100
字数：65536 words字数代码：64000
工作模式：ASYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：64KX9
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装形状：SQUARE封装形式：FLATPACK
并行/串行：PARALLEL最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子形式：GULL WING
端子位置：QUADBase Number Matches：1

70V18L15PFG8 数据手册

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HIGH-SPEED 3.3V  
64K x 9 DUAL-PORT  
STATIC RAM  
IDT70V18L  
Features  
◆
◆
True Dual-Ported memory cells which allow simultaneous  
access of the same memory location  
High-speed access  
IDT70V18 easily expands data bus width to 18 bits or  
more using the Master/Slave select when cascading more  
than one device  
◆
◆
◆
– Commercial: 15/20ns (max.)  
– Industrial: 20ns (max.)  
M/S = VIH for BUSY output flag on Master,  
M/S = VIL for BUSY input on Slave  
◆
Low-power operation  
Full on-chip hardware support of semaphore signaling  
between ports  
– IDT70V18L  
◆
◆
◆
◆
Active: 440mW (typ.)  
Fully asynchronous operation from either port  
LVTTL-compatible, single 3.3V (±0.3V) power supply  
Available in a 100-pin TQFP  
Standby: 660µW (typ.)  
◆
Dual chip enables allow for depth expansion without  
external logic  
Industrial temperature range (–40°C to +85°C) is available  
for selected speeds  
◆
◆
Busy and Interrupt Flags  
◆
On-chip port arbitration logic  
Green parts available, see ordering information  
Functional Block Diagram  
R/WL  
CE0L  
CE1L  
R/WR  
CE0  
R
CE1R  
OEL  
OER  
I/O  
Control  
I/O  
Control  
0-8L  
I/O  
0-8R  
I/O  
(1,2)  
L
(1,2)  
R
BUSY  
BUSY  
64Kx9  
MEMORY  
ARRAY  
70V18  
A
15L  
A
A
15R  
0R  
Address  
Decoder  
Address  
Decoder  
A
0L  
16  
16  
ARBITRATION  
INTERRUPT  
SEMAPHORE  
LOGIC  
CE 0L  
CE1L  
CE0R  
CE1R  
OER  
OE  
L
R/WL  
R/W  
R
SEM  
INT  
L
L
SEM  
R
(2)  
(2)  
INT  
R
M/S(1)  
4854 drw 01  
NOTES:  
1. BUSY is an input as a Slave (M/S=VIL) and an output when it is a Master (M/S=VIH).  
2. BUSY and INT are non-tri-state totem-pole outputs (push-pull).  
MARCH 2015  
1
©2015 Integrated Device Technology, Inc.  
DSC-4854/6  
1234567...18

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与70V18L15PFG8相关器件

型号 品牌 获取价格 描述 数据表
70V18L15PFGI8 IDT

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 		Dual-Port SRAM
70V18L20PFG IDT

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 		Dual-Port SRAM, 64KX9, 20ns, CMOS, PQFP100, 14 X 14 MM, 1.40 MM HEIGHT, GREEN, TQFP-100
70V18L20PFG8 IDT

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 		Dual-Port SRAM, 64KX9, 20ns, CMOS, PQFP100, 14 X 14 MM, 1.40 MM HEIGHT, GREEN, TQFP-100
70V18L20PFGI IDT

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 		Dual-Port SRAM, 64KX9, 20ns, CMOS, PQFP100, 14 X 14 MM, 1.40 MM HEIGHT, GREEN, TQFP-100
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 		Dual-Port SRAM, 64KX9, 20ns, CMOS, PQFP100, 14 X 14 MM, 1.40 MM HEIGHT, GREEN, TQFP-100
70V19L15PFI9 IDT

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 		TQFP-100, Tray
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