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YW80486DX4WB100

更新时间： 2024-11-14 20:52:47

品牌	Logo	应用领域
英特尔 - INTEL		外围集成电路
页数	文件大小	规格书
49页	1342K
描述
RISC Microprocessor, 32-Bit, 100MHz, CMOS, PQFP208

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YW80486DX4WB100 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	QFP, QFP208,1.2SQ,20	Reach Compliance Code：	compliant
风险等级：	5.8	位大小：	32
JESD-30 代码：	S-PQFP-G208	端子数量：	208
封装主体材料：	PLASTIC/EPOXY	封装代码：	QFP
封装等效代码：	QFP208,1.2SQ,20	封装形状：	SQUARE
封装形式：	FLATPACK	电源：	3.3 V
认证状态：	Not Qualified	速度：	100 MHz
子类别：	Microprocessors	最大压摆率：	1450 mA
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
uPs/uCs/外围集成电路类型：	MICROPROCESSOR, RISC	Base Number Matches：	1

YW80486DX4WB100 数据手册

EMBEDDED WRITE-BACK ENHANCED

IntelDX4™ PROCESSOR

■ Up to 100 MHz Operation

■ SL Technology

■ Integrated Floating-Point Unit

■ Speed-Multiplying Technology

■ 32-Bit RISC Technology Core

■ 16-Kbyte Write-Back Cache

■ Data Bus Parity Generation and Checking

■ Boundary Scan (JTAG)

■ 3.3-Volt Processor, 75 MHz, 25 MHz CLK

— 208-Lead Shrink Quad Flat Pack (SQFP)

■ 3.3-Volt Processor, 100 MHz, 33 MHz CLK

— 208-Lead Shrink Quad Flat Pack (SQFP)

— 168-Pin Pin Grid Array (PGA)

■ 3.3 V Core Operation with 5 V Tolerant

I/O Buffers

■ Burst Bus Cycles

■ Binary Compatible with Large Software

■ Dynamic Bus Sizing for 8- and 16-bit

Base

Data Bus Devices

64-Bit Interunit Transfer Bus

32-Bit Data Bus

CLKMUL

Core

Clock

CLK

Clock

Multiplier

32-Bit Data Bus

Linear Address

PCD

PWT

Bus Interface

Base/

Index

Bus

A31-A2 BE3#- BE0#

Barrel

Shifter

Segmentation

Cache Unit

Unit

Paging

Unit

Address

Drivers

Descriptor

Registers

File

Write Buffers

4 x 32

Physical

Address

16 Kbyte

Cache

D31-D0

Translation

Lookaside

Buffer

Limit and

Attribute PLA

Data Bus

Transceivers

ALU

ADS# W/R# D/C# M/IO# PCD

PWT RDY# LOCK# PLOCK#

BOFF# A20M# BREQ HOLD

HLDA RESET SRESET INTR

NMI SMI# SMIACT# FERR#

IGNNE# STPCLK#

Bus Control

Displacement Bus

Request

Sequencer

Prefetcher

Micro-

Instruction

BRDY# BLAST#

BS16# BS8#

Burst Bus

Control

32-Byte Code

Queue

Bus Size

Control

Code

Stream

KEN# FLUSH# AHOLD EADS#

CACHE# HITM# INV WB/WT#

2 x 16 Bytes

Control &

Protection

Test Unit

Cache

Control

Floating

Point Unit

Instruction

Decode

Parity

Generation

and Control

PCHK# DP3-DP0

Floating

Point

Decoded

Instruction

Path

Control

ROM

Boundary

Scan

TCK TMS TDI TDO

Control

A3232-01

Figure 1. Embedded Write-Back Enhanced IntelDX4™ Processor Block Diagram

12 3 4 5 6 7...49

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